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參數(shù)資料
| 型號(hào)： | MC33993 |
| 廠商： | 飛思卡爾半導(dǎo)體(中國(guó))有限公司 |
| 英文描述： | Multiple Switch Detection Interface(多開關(guān)監(jiān)測(cè)接口) |
| 中文描述： | 多交換檢測(cè)接口（多開關(guān)監(jiān)測(cè)接口） |
| 文件頁(yè)數(shù)： | 6/28頁(yè) |
| 文件大?。?/td> | 820K |
| 代理商： | MC33993 |
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33993/D
6
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DIGITAL INTERFACE
Input Logic Voltage Thresholds (Note 10)
V
INLOGIC
0.8
–
2.2
V
SCLK, SI, Tri-State SO Input Current
0 V to V
DD
I
SCLK,
I
SI,
I
SO(Tri)
-10
–
10
μ
A
CS
Input Current
CS
= V
DD
I
CS
-10
–
10
μ
A
CS
Pull-Up Current
CS
= 0 V
I
CS
30
–
100
μ
A
SO High-State Output Voltage
I
SO(
high)
= -200
μ
A
V
SO(
high)
V
DD
- 0.8
–
V
DD
V
SO Low-State Output Voltage
I
SO(
high)
= 1.6 mA
V
SO(
low)
–
–
0.4
V
Input Capacitance on SCLK, SI, Tri-State SO (Note 11)
C
IN
–
–
20
pF
INT
Internal Pull-Up Current
–
15
40
100
μ
A
INT
Voltage
INT
= Open Circuit
V
INT
(
high
)
V
DD
- 0.5
–
V
DD
V
INT
Voltage
I
INT
= 1.0 mA
V
INT
(low)
–
0.2
0.4
V
WAKE
Internal Pull-Up Current
I
WAKE
(
pu
)
20
40
100
μ
A
WAKE
Voltage
WAKE
= Open Circuit
V
WAKE
(
high
)
4.0
4.3
5.3
V
WAKE
Voltage
I
WAKE
= 1.0 mA
V
WAKE
(
low
)
–
0.2
0.4
V
WAKE
Voltage
Maximum Voltage Applied to
WAKE
Through External Pull-Up
V
WAKE
(
max
)
–
–
40
V
Notes
10.
11.
Upper and lower logic threshold voltage levels apply to SI,
CS
, and SCLK.
This parameter is guaranteed by design but is not production tested.
STATIC ELECTRICAL CHARACTERISTICS (continued)
Characteristics noted under conditions of 3.1 V
≤
V
DD
≤
5.25 V, 8.0 V
≤
V
PWR
≤
16 V, -40
°
C
≤
T
C
≤
125
°
C, unless otherwise noted.
Where applicable, typical values reflect the parameter’s approximate average value with V
PWR
= 13 V, T
A
= 25
°
C.
Characteristic
Symbol
Min
Typ
Max
Unit
F
Freescale Semiconductor, Inc.
For More Information On This Product,
n
.
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