參數(shù)資料
型號： MC56F8355VFGE
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 數(shù)字信號處理
英文描述： 4-BIT, 120 MHz, OTHER DSP, PQFP128
封裝： ROHS COMPLIANT, PLASTIC, LQFP-128
文件頁數(shù)： 19/172頁
文件大?。?/td> 844K
代理商： MC56F8355VFGE
Register Descriptions
56F8355 Technical Data, Rev. 17
Freescale Semiconductor
115
Preliminary
Figure 6-11 GPIO Peripheral Select Register (SIM_GPS)
6.5.8.1
Reserved—Bits 15–4
This bit field is reserved or not implemented. It is read as 0 and cannot be modified by writing.
6.5.8.2
GPIOC3 (C3)—Bit 3
This bit selects the alternate function for GPIOC3.
0 = HOME1/TB3 (default - see “Switch Matrix Mode” bits of the Quad Decoder DECCR register in the
56F8300 Peripheral User Manual)
1 = SS1
6.5.8.3
GPIOC2 (C2)—Bit 2
This bit selects the alternate function for GPIOC2.
0 = INDEX1/TB2 (default)
1 = MISO1
6.5.8.4
GPIOC1 (C1)—Bit 1
This bit selects the alternate function for GPIOC1.
0 = PHASEB1/TB1 (default)
1 = MOSI1
SPI input
1
—
1
—
See SPI controls for determining the direction
of each of the SPI pins.
SPI output
1
—
1
—
1. This applies to the four pins that serve as Quad Decoder / Quad Timer / SPI / GPIOC functions. A separate set of control bits
is used for each pin.
2. Reset configuration
3. Quad Decoder pins are always inputs and function in conjunction with the Quad Timer pins.
Base + $B
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Read
0
C3
C2
C1
C0
Write
RESET
00
0
00
0
Table 6-2 Control of Pads Using SIM_GPS Control 1 (Continued)
Pin Function
Control Registers
Comments
GPIOC_PER
GPIOC_DTR
SIM_GPS
Qu
ad
Timer
SC
R
e
gi
st
e
r
OEN
b
its
相關(guān)PDF資料
PDF描述
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MC56F8157VPYE 16-BIT, 120 MHz, OTHER DSP, PQFP160
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