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參數(shù)資料
| 型號(hào)： | MC56F8356MFV60 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | 56F8356 16-bit Hybrid Controller |
| 中文描述： | 16-BIT, 120 MHz, OTHER DSP, PQFP144 |
| 封裝： | LQFP-144 |
| 文件頁數(shù)： | 104/160頁 |
| 文件大小： | 1380K |
| 代理商： | MC56F8356MFV60 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁當(dāng)前第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁
104
56F8356 Technical Data
Preliminary
6.5.6.8
This bit controls the pull-up resistors on the FAULTB0, FAULTB1, FAULTB2, and FAULTB3
pins.
PWMB—Bit 8
6.5.6.9
This bit controls the pull-up resistors on the FAULTA0, FAULTA1, and FAULTA2 pins.
PWMA0—Bit 7
6.5.6.10 Reserved—Bit 6
This bit field is reserved or not implemented. It is read as 0 and cannot be modified by writing.
6.5.6.11 CTRL—Bit 5
This bit controls the pull-up resistors on the WR and RD pins.
6.5.6.12 Reserved—Bit 4
This bit field is reserved or not implemented. It is read as 0 and cannot be modified by writing.
6.5.6.13 JTAG—Bit 3
This bit controls the pull-up resistors on the TRST, TMS and TDI pins.
6.5.6.14 Reserved—Bits 2 - 0
This bit field is reserved or not implemented. It is read as 0 and cannot be modified by writing.
6.5.7
The CLKO select register can be used to multiplex out any one of the clocks generated inside the
clock generation and SIM modules. The default value is SYS_CLK. All other clocks primarily
muxed out are for test purposes only, and are subject to significant unspecified latencies at high
frequencies.
CLKO Select Register (SIM_CLKOSR)
The upper four bits of the GPIO B register can function as GPIO, A23 through A20, or as additional
clock output signals. GPIO has priority and is enabled/disabled via the GPIOB_PER. If GPIO
B[7:4] are programmed to operate as peripheral outputs, then the choice between A23 through A20
and additional clock outputs is done here in the CLKOSR. The default state is for the peripheral
function of GPIO B[7:4] to be programmed as A23 through A20. This can be changed by altering
A23 through A20 as shown in
Figure 6-9
.
Figure 6-9 CLKO Select Register (SIM_CLKOSR)
6.5.7.1
This bit field is reserved or not implemented. It is read as 0 and cannot be modified by writing.
Reserved—Bits 15–10
Base + $A
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Read
0
0
0
0
0
0
A23
A22
A21
A20
CLK
DIS
CLKOSEL
Write
RESET
0
0
0
0
0
0
0
0
0
0
1
0
0
0
0
0
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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