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參數(shù)資料
| 型號(hào)： | MC68336AVFT20 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 20.97 MHz, MICROCONTROLLER, PQFP16 |
| 封裝： | PLASTIC, QFP-160 |
| 文件頁數(shù)： | 334/434頁 |
| 文件大?。?/td> | 6093K |
| 代理商： | MC68336AVFT20 |
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MOTOROLA
MC68336/376
iv
USER’S MANUAL
(Continued)
Paragraph
Title
Page
TABLE OF CONTENTS
4.4
Virtual Memory .......................................................................................... 4-9
4.5
Addressing Modes ..................................................................................... 4-9
4.6
Processing States ..................................................................................... 4-9
4.7
Privilege Levels ....................................................................................... 4-10
4.8
Instructions .............................................................................................. 4-10
4.8.1
M68000 Family Compatibility .......................................................... 4-14
4.8.2
Special Control Instructions ............................................................. 4-14
4.8.2.1
Low-Power Stop (LPSTOP) .................................................... 4-14
4.8.2.2
Table Lookup and Interpolate (TBL) ....................................... 4-14
4.8.2.3
Loop Mode Instruction Execution ............................................ 4-15
4.9
Exception Processing .............................................................................. 4-15
4.9.1
Exception Vectors ........................................................................... 4-15
4.9.2
Types of Exceptions ........................................................................ 4-17
4.9.3
Exception Processing Sequence ..................................................... 4-17
4.10
Development Support .............................................................................. 4-17
4.10.1
M68000 Family Development Support ............................................ 4-18
4.10.2
Background Debug Mode ................................................................ 4-18
4.10.3
Enabling BDM ................................................................................. 4-19
4.10.4
BDM Sources .................................................................................. 4-19
4.10.4.1
External BKPT Signal .............................................................. 4-20
4.10.4.2
BGND Instruction .................................................................... 4-20
4.10.4.3
Double Bus Fault ..................................................................... 4-20
4.10.4.4
Peripheral Breakpoints ............................................................ 4-20
4.10.5
Entering BDM .................................................................................. 4-20
4.10.6
BDM Commands ............................................................................. 4-21
4.10.7
Background Mode Registers ........................................................... 4-22
4.10.7.1
Fault Address Register (FAR) ................................................. 4-22
4.10.7.2
Return Program Counter (RPC) .............................................. 4-22
4.10.7.3
Current Instruction Program Counter (PCC) ........................... 4-23
4.10.8
Returning from BDM ........................................................................ 4-23
4.10.9
Serial Interface ................................................................................ 4-23
4.10.10
Recommended BDM Connection .................................................... 4-25
4.10.11
Deterministic Opcode Tracking ....................................................... 4-26
4.10.12
On-Chip Breakpoint Hardware ........................................................ 4-26
SECTION 5 SYSTEM INTEGRATION MODULE
5.1
General ...................................................................................................... 5-1
5.2
System Configuration ................................................................................ 5-2
5.2.1
Module Mapping ................................................................................ 5-2
5.2.2
Interrupt Arbitration ............................................................................ 5-2
5.2.3
Show Internal Cycles ......................................................................... 5-3
336376UMBook Page iv Friday, November 15, 1996 2:09 PM
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