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參數(shù)資料
| 型號(hào)： | MC68HC05L16 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 80-Pin Microcontroller Unit (MCU) With Highly Sophisticated On-Chip Peripheral Functions(80腳、8位帶高級(jí)外圍電路功能的微控制器單元) |
| 中文描述： | 80管腳微控制器與高（MCU）的一套成熟的片上外設(shè)功能（80腳，8位帶高級(jí)外圍電路功能的微控制器單元） |
| 文件頁(yè)數(shù)： | 125/200頁(yè) |
| 文件大?。?/td> | 1937K |
| 代理商： | MC68HC05L16 |
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Timer System
Timer 2
MC68HC(7)05L16
—
Rev. 3.0
General Release Specification
MOTOROLA
Timer System
125
L
G
R
The CLK2 from the prescaler or the EXTCLK from the EVI block is
selected as timer clock by the T2CLK bit in the TCR2 register. The CLK2
and the EXCLK are synchronized to the falling edge of system clock in
the prescaler and the EVI blocks. The minimum pulse width of CLK2 is
the same as the system clock, and the minimum pulse width of EXCLK
(event mode) is one PH2 cycle. When the EXCLK (event mode) is
selected, 50% duty is not guaranteed.
The counter is incremented by the falling edge of the timer clock and the
period between two falling edges is defined as one timer cycle in the
following description.
The compare register (OC2) is provided for comparison with the timer
counter 2 (TCNT2). The OC2 data is transferred to the buffer register
when the counter is preset by a CPU write or by a compare output
(CMP2). This buffer register is compared with the timer counter 2
(TCNT2).
The comparison between the counter and the OC2 buffer register is
done when the system clock is high in each bus cycle. If the counter
matches with the OC2 buffer register, the comparator latches this result
during the current timer cycle. When the next timer cycle begins, the
comparator outputs CMP2 signal (if the compare match is detected
during previous timer cycle). This CMP2 is used in the counter preset
data transfer to the buffer register, setting OC2F in the TSR2 and the
EVO block. The counter preset overrides the counter increment.
The OC2F bit may generate interrupt requests if the OC2IE bit in the
TCR2 is set.
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PDF描述 |
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參數(shù)描述 |
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