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參數(shù)資料
| 型號： | MC68HC05L25PB |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQFP52 |
| 封裝： | TQFP-52 |
| 文件頁數(shù)： | 171/212頁 |
| 文件大小： | 2286K |
| 代理商： | MC68HC05L25PB |
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Interrupts
Reset Interrupt Sequence
MC68HC05L25 — Rev. 3.0
Technical Data
MOTOROLA
Interrupts
61
An RTI instruction is used to signify when the interrupt software service
routine is completed. The RTI instruction causes the register contents to
be recovered from the stack and normal processing to resume at the
next instruction that was to be executed when the interrupt took place.
Figure 6-1 shows the sequence of events that occurs during interrupt
processing.
6.4 Reset Interrupt Sequence
The reset function is not in the strictest sense an interrupt; however,
it is acted upon in a similar manner as shown in Figure 6-1. A low
level input on the RESET pin or internally generated RST signal causes
the program to vector to its starting address, which is specified by the
contents of memory locations $1FFE through $1FFF. The I bit in the
condition code register also is set. The MCU is configured to a known
state during this type of reset as previously described in Section 5.
6.5 Software Interrupt (SWI)
The SWI is an executable instruction and a nonmaskable interrupt since
it is executed regardless of the state of the I bit in the CCR. If the I bit is
Table 6-1. Vector Address for Interrupts and Reset
Register
Flag
Name
Interrupts
CPU
Interrupt
Vector
Address
N/A
Reset
RESET
$1FFE:$1FFF
N/A
Software
SWI
$1FFC:$1FFD
INTCR
IRQF
External Interrupt
IRQ
$1FFA:$1FFB
KWIEN
KWIF
Key Wakeup
KWI
$1FF8:$1FF9
——
Reserved
—
$1FF6:$1FF7
EVSCR
ECOF
Event Counter
EVI
$1FF4:$1FF5
SPSR
SPIF
Serial Peripheral
SPII
$1FF2:$1FF3
TBCR2
TBIF
Time Base Periodical
TBI
$1FF0:$1FF1
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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