參數(shù)資料
型號(hào): MC68HC05L25PB
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQFP52
封裝: TQFP-52
文件頁數(shù): 39/212頁
文件大?。?/td> 2286K
代理商: MC68HC05L25PB
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Serial Peripheral Interface
Block Diagram
MC68HC05L25 Rev. 3.0
Technical Data
MOTOROLA
Serial Peripheral Interface
133
10.4.8 Serial Data In (SDI)
The SDI pin is multiplexed with a general-purpose I/O pin. This becomes
an input-only pin and accepts serial input data when the SPI is enabled.
10.4.9 Serial Clock (SCK)
The SCK pin is used for synchronization of both input and output data
streams through SDI and SDO pins. The SCK pin should be at VDD level
before SPI is enabled.
The master and slave devices are capable of exchanging a data byte
during a sequence of eight clock pulses. Since SCK is generated by the
master, slave data transfer is accomplished by synchronization of SCK.
When the MSTR bit in the SPCR is set, SCK becomes an output and the
serial clock is supplied to the internal and external systems. When the
serial clock is idling, high level is being output. When the bit is a logic 1,
the CPU writes data to SPCR and outputs eight clock pulses. After the
end of the eighth clock, high level is being output while idling. The clock
speed in master mode is one-half the system clock.
When the MSTR bit in the SPCR is cleared, SCK becomes an input and
the external system supplies the serial clock while the internal system
operates by synchronizing to this clock. After eight serial clocks are input
to the SCK pin, the SPIF bit in the SPSR is set and will not receive the
next serial clock input until the SPIF bit is cleared. The clock speed in
slave mode is dependent upon the speed of the external system and has
a maximum speed up till the internal system clock.
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