- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄371047 > MC68HC08AS32 (Motorola, Inc.) 8-Bit Microcontroller Units (MCUs) With Embedded EEPROM For User Data Storage(8位微控制器單元(MCUs)，帶嵌入式EEPROM數(shù)據(jù)存儲(chǔ)單元) PDF資料下載
參數(shù)資料
| 型號(hào)： | MC68HC08AS32 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 8-Bit Microcontroller Units (MCUs) With Embedded EEPROM For User Data Storage(8位微控制器單元(MCUs)，帶嵌入式EEPROM數(shù)據(jù)存儲(chǔ)單元) |
| 中文描述： | 8位微控制器單元（MCU）與嵌入式對(duì)于用戶數(shù)據(jù)存儲(chǔ)（8位微控制器單元（MCU）的，帶嵌入式EEPROM的數(shù)據(jù)存儲(chǔ)單元的EEPROM） |
| 文件頁(yè)數(shù)： | 212/394頁(yè) |
| 文件大?。?/td> | 3174K |
| 代理商： | MC68HC08AS32 |
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L
G
R
Timer Interface (TIM)
Advance Information
MC68HC08AS32
—
Rev. 3.0
212
Timer Interface (TIM)
MOTOROLA
16.4.3.2 Buffered Output C ompare
Channels 0 and 1 can be linked to form a buffered output compare
channel whose output appears on the PTE2/TCH0 pin. The TIM channel
registers of the linked pair alternately control the output.
Setting the MS0B bit in TIM channel 0 status and control register (TSC0)
links channel 0 and channel 1. The output compare value in the TIM
channel 0 registers initially controls the output on the PTE2/TCH0 pin.
Writing to the TIM channel 1 registers enables the TIM channel 1
registers to synchronously control the output after the TIM overflows. At
eachsubsequentoverflow,theTIMchannelregisters(0or1)thatcontrol
the output are the ones written to last. TSC0 controls and monitors the
buffered output compare function, and TIM channel 1 status and control
register (TSC1) is unused. While the MS0B bit is set, the channel 1 pin,
PTE3/TCH1, is available as a general-purpose I/O pin.
Channels 2 and 3 can be linked to form a buffered output compare
channel whose output appears on the PTF0/TCH2 pin. The TIM channel
registers of the linked pair alternately control the output.
Setting the MS2B bit in TIM channel 2 status and control register (TSC2)
links channel 2 and channel 3. The output compare value in the TIM
channel 2 registers initially controls the output on the PTF0/TCH2 pin.
Writing to the TIM channel 3 registers enables the TIM channel 3
registers to synchronously control the output after the TIM overflows. At
eachsubsequentoverflow,theTIMchannelregisters(2or3)thatcontrol
the output are the ones written to last. TSC2 controls and monitors the
buffered output compare function, and TIM channel 3 status and control
register (TSC3) is unused. While the MS2B bit is set, the channel 3 pin,
PTF1/TCH3, is available as a general-purpose I/O pin.
Channels 4 and 5 can be linked to form a buffered output compare
channel whose output appears on the PTF2/TCH4 pin. The TIM channel
registers of the linked pair alternately control the output.
Setting the MS4B bit in TIM channel 4 status and control register (TSC4)
links channel 4 and channel 5. The output compare value in the TIM
channel 4 registers initially controls the output on the PTF2/TCH4 pin.
Writing to the TIM channel 5 registers enables the TIM channel 5
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| MC68HC08AZ32 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Advance Information |
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