- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄371047 > MC68HC08AS32 (Motorola, Inc.) 8-Bit Microcontroller Units (MCUs) With Embedded EEPROM For User Data Storage(8位微控制器單元(MCUs)，帶嵌入式EEPROM數(shù)據(jù)存儲單元) PDF資料下載
參數(shù)資料
| 型號： | MC68HC08AS32 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 8-Bit Microcontroller Units (MCUs) With Embedded EEPROM For User Data Storage(8位微控制器單元(MCUs)，帶嵌入式EEPROM數(shù)據(jù)存儲單元) |
| 中文描述： | 8位微控制器單元（MCU）與嵌入式對于用戶數(shù)據(jù)存儲（8位微控制器單元（MCU）的，帶嵌入式EEPROM的數(shù)據(jù)存儲單元的EEPROM） |
| 文件頁數(shù)： | 362/394頁 |
| 文件大?。?/td> | 3174K |
| 代理商： | MC68HC08AS32 |
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L
G
R
Byte Data Link Controller-Digital (BDLC-D)
Advance Information
MC68HC08AS32
—
Rev. 3.0
362
Byte Data Link Controller-Digital (BDLC-D)
MOTOROLA
programmer should set TEOD after the last IFR byte has been written
into the BDR register. After TEOD has been set and the last IFR byte
has been transmitted, the CRC byte is transmitted.
0 = The TMIFR1 bit will be cleared automatically – once the BDLC
has successfully transmitted the CRC byte and EOD
symbol – by the detection of an error on the multiplex bus or by
a transmitter underrun caused when the programmer does not
write another byte to the BDR after the TDRE interrupt.
If the TMIFR1 bit is set, the BDLC will attempt to transmit the
normalization symbol followed by the byte in the BDR. After the byte
in the BDR has been loaded into the transmit shift register, a TDRE
interrupt (see
20.7.4 BDLC State Vector Register
) will occur similar
to the main message transmit sequence. The programmer should
then load the next byte of the IFR into the BDR for transmission.
When the last byte of the IFR has been loaded into the BDR, the
programmer should set the TEOD bit in the BDLC control register 2
(BCR2). This will instruct the BDLC to transmit a CRC byte once the
byte in the BDR is transmitted and then transmit an EOD symbol,
indicating the end of the IFR portion of the message frame.
However, if the programmer wishes to transmit a single byte followed
by a CRC byte, the programmer should load the byte into the BDR
before the EOD symbol has been received, and then set the TMIFR1
bit. Once the TDRE interrupt occurs, the programmer should then set
the TEOD bit in the BCR2. This will result in the byte in the BDR being
the only byte transmitted before the IFR CRC byte, and no TDRE
interrupt will be generated.
If the programmer attempts to set the TMIFR1 bit immediately after
the EOD symbol has been received from the bus, the TMIFR1 bit will
remain in the reset state, and no attempt will be made to transmit an
IFR byte.
If a loss of arbitration occurs when the BDLC is transmitting any byte
of a multiple byte IFR, the BDLC will go to the loss of arbitration state,
set the appropriate flag, and cease transmission.
If the BDLC loses arbitration during the IFR, the TMIFR1 bit will be
clearedandnoattemptwillbemadetoretransmitthebyteintheBDR.
If loss of arbitration occurs in the last two bits of the IFR byte, two
additional 1 bits will be sent out.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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