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參數(shù)資料
| 型號： | MC68HC08JB1 |
| 廠商： | Motorola, Inc. |
| 英文描述： | Low-Cost, High-Performance M68HC08 Family of 8-Bit Microcontroller Units (MCUs)(低成本、高性能M68HC08系列的8位微控制器(MCUs)) |
| 中文描述： | 低成本，高性能M68HC08系列系列的8位微控制器單元（MCU）（低成本，高性能M68HC08系列系列的8位微控制器（MCU）的） |
| 文件頁數(shù)： | 149/214頁 |
| 文件大?。?/td> | 2186K |
| 代理商： | MC68HC08JB1 |
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Timer Interface Module (TIM)
Interrupts
MC68HC08JB1
—
Rev. 1.0
Technical Data
MOTOROLA
Timer Interface Module (TIM)
149
5.
In the TIM status control register (TSC), clear the TIM stop bit,
TSTOP.
Setting MS0B links channels 0 and 1 and configures them for buffered
PWM operation. The TIM channel 0 registers (TCH0H:TCH0L) initially
control the buffered PWM output. TIM status control register 0 (TSCR0)
controls and monitors the PWM signal from the linked channels. MS0B
takes priority over MS0A.
Clearing the toggle-on-overflow bit, TOVx, inhibits output toggles on TIM
overflows. Subsequent output compares try to force the output to a state
it is already in and have no effect. The result is a 0% duty cycle output.
Setting the channel x maximum duty cycle bit (CHxMAX) and clearing
the TOVx bit generates a 100% duty cycle output. (See
10.9.4 TIM
Channel Status and Control Registers
.)
10.6 Interrupts
The following TIM sources can generate interrupt requests:
TIM overflow flag (TOF) — The TOF bit is set when the TIM
counter value rolls over to $0000 after matching the value in the
TIM counter modulo registers. The TIM overflow interrupt enable
bit, TOIE, enables TIM overflow CPU interrupt requests. TOF and
TOIE are in the TIM status and control register.
TIM channel flags (CH1F:CH0F) — The CHxF bit is set when an
input capture or output compare occurs on channel x. Channel x
TIM CPU interrupt requests are controlled by the channel x
interrupt enable bit, CHxIE. Channel x TIM CPU interrupt requests
are enabled when CHxIE = 1. CHxF and CHxIE are in the TIM
channel x status and control register.
10.7 Wait Mode
The WAIT instruction puts the MCU in low-power-consumption standby
mode.
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