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參數(shù)資料
| 型號(hào)： | MC68HC711E20CFU2 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, OTPROM, 2 MHz, MICROCONTROLLER, PQFP64 |
| 封裝： | QFP-64 |
| 文件頁(yè)數(shù)： | 54/242頁(yè) |
| 文件大?。?/td> | 1672K |
| 代理商： | MC68HC711E20CFU2 |
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Pulse Accumulator
M68HC11E Family Data Sheet, Rev. 5.1
Freescale Semiconductor
147
PAII and PAIF — Pulse Accumulator Input Edge Interrupt Enable Bit and Flag
The PAIF status bit is automatically set each time a selected edge is detected at the PA7/PAI/OC1 pin.
To clear this status bit, write to the TFLG2 register with a 1 in the corresponding data bit position (bit
4). The PAII control bit allows configuring the pulse accumulator input edge detect for polled or
interrupt-driven operation but does not affect setting or clearing the PAIF bit. When PAII is 0, pulse
accumulator input interrupts are inhibited, and the system operates in a polled mode. In this mode, the
PAIF bit must be polled by user software to determine when an edge has occurred. When the PAII
control bit is set, a hardware interrupt request is generated each time PAIF is set. Before leaving the
interrupt service routine, software must clear PAIF by writing to the TFLG2 register.
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PDF描述 |
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