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參數(shù)資料
| 型號： | MC68HC908GR60AMFA |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP48 |
| 封裝： | LQFP-48 |
| 文件頁數(shù)： | 125/342頁 |
| 文件大?。?/td> | 4527K |
| 代理商： | MC68HC908GR60AMFA |
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System Integration Module (SIM)
Data Sheet
MC68HC908GR60A MC68HC908GR48A MC68HC908GR32A
210
System Integration Module (SIM)
MOTOROLA
14.3.2.2 Computer Operating Properly (COP) Reset
An input to the SIM is reserved for the COP reset signal. The overflow of the COP
counter causes an internal reset and sets the COP bit in the SIM reset status
register (SRSR) if the COPD bit in the CONFIG1 register is cleared. The SIM
actively pulls down the RST pin for all internal reset sources.
The COP module is disabled if the RST pin or the IRQ pin is held at VTST while the
MCU is in monitor mode. During a break state, VTST on the RST pin disables the
COP module.
14.3.2.3 Illegal Opcode Reset
The SIM decodes signals from the CPU to detect illegal instructions. An illegal
instruction sets the ILOP bit in the SIM reset status register (SRSR) and causes a
reset.
If the stop enable bit, STOP, in the CONFIG1 register is 0, the SIM treats the STOP
instruction as an illegal opcode and causes an illegal opcode reset. The SIM
actively pulls down the RST pin for all internal reset sources.
14.3.2.4 Illegal Address Reset
An opcode fetch from an unmapped address generates an illegal address reset.
The SIM verifies that the CPU is fetching an opcode prior to asserting the ILAD bit
in the SIM reset status register (SRSR) and resetting the MCU. A data fetch from
an unmapped address does not generate a reset. The SIM actively pulls down the
RST pin for all internal reset sources.
14.3.2.5 Low-Voltage Inhibit (LVI) Reset
The low-voltage inhibit module (LVI) asserts its output to the SIM when the VDD
voltage falls to the VTRIPF voltage. The LVI bit in the SIM reset status register
(SRSR) is set, and the external reset pin (RST) is asserted if the LVIPWRD and
LVIRSTD bits in the CONFIG1 register are 0. The RST pin will be held low while
the SIM counter counts out 4096 + 32 CGMXCLK cycles after VDD rises above
VTRIPR. Thirty-two CGMXCLK cycles later, the CPU is released from reset to allow
the reset vector sequence to occur. The SIM actively pulls down the RST pin for all
internal reset sources.
14.3.2.6 Monitor Mode Entry Module Reset (MODRST)
The monitor mode entry module reset (MODRST) asserts its output to the SIM
when monitor mode is entered in the condition where the reset vectors are erased
($FF) (see 19.3.1.1 Normal Monitor Mode). When MODRST gets asserted, an
internal reset occurs. The SIM actively pulls down the RST pin for all internal reset
sources.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68HC908GR48ACFU | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP64 |
| MC68HC908GR48ACFA | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP48 |
| MC68HC908GR32AMFA | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP48 |
| MC68HC908GR32ACFJ | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP32 |
| MC68HC908GR48AVFU | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP64 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68HC908GR8ACFA | 制造商:Rochester Electronics LLC 功能描述:- Bulk 制造商:Motorola Inc 功能描述: 制造商:MOTOROLA 功能描述: |
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| MC68HC908GR8AVFA | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| MC68HC908GR8CB | 制造商:Rochester Electronics LLC 功能描述:8 BIT MCU, 7.5K FLASH - Bulk |
| MC68HC908GR8CD | 功能描述:8位微控制器 -MCU 8 Bit 8MHz RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
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