參數(shù)資料
型號: MC68HC908GR8AVFA
廠商: FREESCALE SEMICONDUCTOR INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, FLASH, 8.2 MHz, MICROCONTROLLER, PQFP32
封裝: 7 X 7 MM, 1.40 MM HEIGHT, 0.80 MM PITCH, LQFP-32
文件頁數(shù): 22/260頁
文件大?。?/td> 3315K
代理商: MC68HC908GR8AVFA
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Input/Output (I/O) Ports
MC68HC908GR8A MC68HC908GR4A Data Sheet, Rev. 5
118
Freescale Semiconductor
PTA3–PTA0 — Port A Data Bits
These read/write bits are software programmable. Data direction of each port A pin is under the control
of the corresponding bit in data direction register A. Reset has no effect on port A data.
KBD3–KBD0 — Keyboard Inputs
The keyboard interrupt enable bits, KBIE3–KBIE0, in the keyboard interrupt control register (KBICR)
enable the port A pins as external interrupt pins. See Chapter 9 Keyboard Interrupt Module (KBI).
12.2.2 Data Direction Register A
Data direction register A (DDRA) determines whether each port A pin is an input or an output. Writing a 1
to a DDRA bit enables the output buffer for the corresponding port A pin; a 0 disables the output buffer.
DDRA3–DDRA0 — Data Direction Register A Bits
These read/write bits control port A data direction. Reset clears DDRA3–DDRA0, configuring all port
A pins as inputs.
1 = Corresponding port A pin configured as output
0 = Corresponding port A pin configured as input
NOTE
Avoid glitches on port A pins by writing to the port A data register before
changing data direction register A bits from 0 to 1.
Figure 12-4 shows the port A I/O logic.
Figure 12-4. Port A I/O Circuit
Address:
$0004
Bit 7
654321
Bit 0
Read:
0000
DDRA3
DDRA2
DDRA1
DDRA0
Write:
Reset:
00000000
= Unimplemented
Figure 12-3. Data Direction Register A (DDRA)
READ DDRA ($0004)
WRITE DDRA ($0004)
RESET
WRITE PTA ($0000)
READ PTA ($0000)
PTAx
DDRAx
PTAx
INTERNA
LDA
TA
BUS
VDD
PTAPUEx
INTERNAL
PULLUP
DEVICE
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