參數(shù)資料
型號: MC68HC908GR8AVFA
廠商: FREESCALE SEMICONDUCTOR INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, FLASH, 8.2 MHz, MICROCONTROLLER, PQFP32
封裝: 7 X 7 MM, 1.40 MM HEIGHT, 0.80 MM PITCH, LQFP-32
文件頁數(shù): 225/260頁
文件大?。?/td> 3315K
代理商: MC68HC908GR8AVFA
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CGM Registers
MC68HC908GR8A MC68HC908GR4A Data Sheet, Rev. 5
Freescale Semiconductor
67
if the PLL is off. Therefore, PLLON cannot be cleared when BCS is set, and
BCS cannot be set when PLLON is clear. If the PLL is off (PLLON = 0),
selecting CGMVCLK requires two writes to the PLL control register. (See
PRE1 and PRE0 — Prescaler Program Bits
These read/write bits control a prescaler that selects the prescaler power-of-two multiplier, P. (See PLL
Circuits and Programming the PLL.) PRE1 and PRE0 cannot be written when the PLLON bit is set.
Reset clears these bits.
VPR1 and 0 — VCO Power-of-Two Range Select Bits
These read/write bits control the VCO’s hardware power-of-two range multiplier E that, in conjunction
Register.) controls the hardware center-of-range frequency, fVRS. VPR1:VPR0 cannot be written when
the PLLON bit is set. Reset clears these bits.
4.5.2 PLL Bandwidth Control Register
The PLL bandwidth control register (PBWC):
Selects automatic or manual (software-controlled) bandwidth control mode
Indicates when the PLL is locked
In automatic bandwidth control mode, indicates when the PLL is in acquisition or tracking mode
In manual operation, forces the PLL into acquisition or tracking mode
Table 4-2. PRE 1 and PRE0 Programming
PRE1 and PRE0
P
Prescaler Multiplier
00
0
1
01
1
2
10
2
4
11
3
8
Table 4-3. VPR1 and VPR0 Programming
VPR1 and VPR0
E
VCO Power-of-Two
Range Multiplier
00
0
1
01
1
2
10
2
4
11
3(1)
1. Do not program E to a value of 3.
8
Address: $0037
Bit 7
654321
Bit 0
Read:
AUTO
LOCK
ACQ
0000
R
Write:
Reset:
00000000
= Unimplemented
R
= Reserved
Figure 4-5. PLL Bandwidth Control Register (PBWC)
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PDF描述
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