- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄69030 > MC68VZ328CVF33V (MOTOROLA INC) MICROCONTROLLER, PBGA144 PDF資料下載
參數(shù)資料
| 型號： | MC68VZ328CVF33V |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MICROCONTROLLER, PBGA144 |
| 封裝： | 13 X 13 MM, 1 MM PITCH, MOLD ARRAY PROCESS, PLASTIC, BGA-144 |
| 文件頁數(shù)： | 177/284頁 |
| 文件大小： | 5173K |
| 代理商： | MC68VZ328CVF33V |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁當前第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁第268頁第269頁第270頁第271頁第272頁第273頁第274頁第275頁第276頁第277頁第278頁第279頁第280頁第281頁第282頁第283頁第284頁
14-6
MC68VZ328 User’s Manual
UART Operation
14.3.2 Receiver Operation
The receiver block of the UART accepts a serial data stream, converting it into parallel characters. The
receiver operates in two modes—asynchronous and synchronous. In asynchronous mode, it searches for a
start bit, qualifies it, and then samples the succeeding data bits at the perceived bit center. Jitter tolerance
and noise immunity are provided by sampling 16 times per bit and using a voting circuit to enhance
sampling. IrDA operation must use asynchronous mode. In synchronous mode, RXDx is sampled on each
rising edge of the bit clock, which is generated by the UART module or supplied externally. When a start
bit is identified, the remaining bits are shifted in and loaded into the FIFO.
If parity is enabled, the parity bit is checked and its status is reported in the URX register. Similarly, frame
errors, breaks, and overruns are checked and reported. The 4 character status bits in the high byte (bits
11–8) of the URX register are valid only when read as a 16-bit word with the received character byte.
14.3.2.1 Rx FIFO Buffer Operation
As with the transmitter, the receiver FIFO is flexible. If the software being used has short interrupt latency
time, the FIFO FULL interrupt in the URX register can be enabled. The FIFO has no remaining space
available when this interrupt is generated. If the DATA READY bit in the URX register indicates that
more data is remaining in the FIFO, the FIFO can then be emptied byte by byte. If the software has a
longer latency time, the FIFO HALF interrupt of the URX register can be used. This interrupt is generated
when no more than 4 empty bytes remain in the FIFO. If the FIFO is not needed, the DATA READY
interrupt should be used. This interrupt is generated when one or more characters are present in the FIFO.
The OLD DATA bit in the URX register indicates that there is data in the FIFO and that the receive line
has been idle for more than 30 bit times. This is useful in determining the end of a block of characters.
When IrDA mode is enabled, the receiver expects narrow (1.63
s at a minimum) pulses for each zero bit
received. Otherwise, normal NRZ is expected. An infrared transceiver directly connected to the RXDx pin
transforms the infrared signal into an electrical signal. Polarity is programmable so that RXDx can be
connected directly to an external IrDA transceiver.
14.3.3 Baud Rate Generator Operation
The baud generator provides the bit clocks to the transmitter and receiver blocks. It consists of two
prescalers, an integer prescaler, and a second non-integer prescaler, as well as a 2n divider. Figure 14-4 on
page 14-7 illustrates a block diagram of the baud rate generator.
相關PDF資料 |
PDF描述 |
|---|---|
| MC68VZ328VF33VR2 | MICROCONTROLLER, PBGA144 |
| MC68VZ328VF33V | MICROCONTROLLER, PBGA144 |
| MC68VZ328CPV33V | MICROCONTROLLER, PQFP144 |
| MC88200RC25 | 32-BIT, MEMORY MANAGEMENT UNIT, CPGA180 |
| MC8DE16G5APP-0XA | FLASH MEMORY DRIVE CONTROLLER, PQFP |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MC68VZ328CVP | 功能描述:IC MPU 32BIT 144-MAPBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標準包裝:1 系列:MPC85xx 處理器類型:32-位 MPC85xx PowerQUICC III 特點:- 速度:1.2GHz 電壓:1.1V 安裝類型:表面貼裝 封裝/外殼:783-BBGA，F(xiàn)CBGA 供應商設備封裝:783-FCPBGA（29x29） 包裝:托盤 |
| MC68VZ328CVPR2 | 功能描述:IC MPU 32BIT 144-MAPBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標準包裝:1 系列:MPC85xx 處理器類型:32-位 MPC85xx PowerQUICC III 特點:- 速度:1.2GHz 電壓:1.1V 安裝類型:表面貼裝 封裝/外殼:783-BBGA，F(xiàn)CBGA 供應商設備封裝:783-FCPBGA（29x29） 包裝:托盤 |
| MC68VZ328PV | 制造商:Motorola Inc 功能描述: |
| MC68VZ328VP | 功能描述:IC MPU 32BIT 144-MAPBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標準包裝:1 系列:MPC85xx 處理器類型:32-位 MPC85xx PowerQUICC III 特點:- 速度:1.2GHz 電壓:1.1V 安裝類型:表面貼裝 封裝/外殼:783-BBGA，F(xiàn)CBGA 供應商設備封裝:783-FCPBGA（29x29） 包裝:托盤 |
| MC68VZ328VPR2 | 功能描述:IC MPU 32BIT 144-MAPBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標準包裝:1 系列:MPC85xx 處理器類型:32-位 MPC85xx PowerQUICC III 特點:- 速度:1.2GHz 電壓:1.1V 安裝類型:表面貼裝 封裝/外殼:783-BBGA，F(xiàn)CBGA 供應商設備封裝:783-FCPBGA（29x29） 包裝:托盤 |
發(fā)布緊急采購，3分鐘左右您將得到回復。