參數(shù)資料
型號(hào)： MC88920DW
廠商： MOTOROLA INC
元件分類： 時(shí)鐘及定時(shí)
英文描述： LOW SKEW CMOS PLL CLOCK DRIVER With Power-Down/ Power-Up Feature
中文描述： 88920 SERIES, PLL BASED CLOCK DRIVER, 5 TRUE OUTPUT(S), 1 INVERTED OUTPUT(S), PDSO20
封裝： PLASTIC, SOIC-20
文件頁數(shù)： 4/10頁
文件大?。?/td> 116K
代理商： MC88920DW
MC88920
MOTOROLA
TIMING SOLUTIONS
BR1333 — REV 5
4
Figure 1. MC88920 Logic Block Diagram
Q
R
D
Q0
VCO
CH
PUMP
PFD
SYNC1
PLL_EN
MR
POWER–ON
RESET
0
1
LOCK INDICATOR AND
RESET_OUT 1024 CYCLE
COUNT CIRCUITRY
RST_IN
2X_Q
RST_OUT
Q
R
D
Q1
Q
R
D
Q2
Q
R
D
“Dummy” Flip–Flop to Maintain
Phase–Locked Operation
Q
R
D
Q3
Q
R
D
Q/2
Q
RC1
÷
2
SYNC INPUT TIMING REQUIREMENTS
Symbol
Parameter
Minimum
Maximum
Unit
tRISE/FALL
SYNC Input
Rise/Fall Time, SYNC Input
From 0.8V to 2.0V
—
5.0
ns
tCYCLE,
SYNC Input
Input Clock Period
SYNC Input
1
f2X_Q4
200
ns
Duty Cycle
Duty Cycle, SYNC Input
50%
±
25%
FREQUENCY SPECIFICATIONS
(TA = 0
°
C to 70
°
C; VCC = 5.0V
±
5%)
Symbol
Parameter
Guaranteed Minimum
Unit
Fmax (2X_Q)
Maximum Operating Frequency, 2X_Q Output
50
MHz
Fmax (‘Q’)
Maximum Operating Frequency,
Q0–Q2, Q3 Outputs
25
MHz
1. Maximum Operating Frequency is guaranteed with the 88920 in a phase–locked condition, and all outputs loaded at 50pF.
相關(guān)PDF資料
PDF描述
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MC88LV915T LOW SKEW CMOS PLL CLOCK DRIVER
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參數(shù)描述
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