參數(shù)資料
型號： MC908GT16CFBER
廠商： Freescale Semiconductor
文件頁數(shù)： 41/292頁
文件大?。?/td> 0K
描述： IC MCU 16K FLASH 8MHZ 44-QFP
標準包裝： 750
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 8MHz
連通性： SCI，SPI
外圍設(shè)備： LVD，POR，PWM
輸入/輸出數(shù)： 36
程序存儲器容量： 16KB（16K x 8）
程序存儲器類型： 閃存
RAM 容量： 512 x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x8b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 44-QFP
包裝： 帶卷 (TR)
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Port E
MC68HC908GT16 MC68HC908GT8 MC68HC08GT16 Data Sheet, Rev. 5.0
Freescale Semiconductor
135
12.6.1 Port E Data Register
The port E data register contains a data latch for each of the five port E pins.
PTE4-PTE0 — Port E Data Bits
These read/write bits are software-programmable. Data direction of each port E pin is under the control
of the corresponding bit in data direction register E. Reset has no effect on port Edata.
NOTE
Data direction register E (DDRE) does not affect the data direction of port
E pins that are being used by the SCI module. However, the DDRE bits
always determine whether reading port E returns the states of the latches
or the states of the pins. See Table 12-6.
OSC2 and OSC1 — OSC2 and OSC1 Bits
Under software control, PTE4 and PTE3 can be configured as external clock inputs and outputs. PTE3
will become an output clock, OSC2, if selected in the configuration registers and enabled in the ICG
registers. PTE4 will become an external input clock source, OSC1, if selected in the configuration
registers and enabled in the ICG registers. See Chapter 7 Internal Clock Generator (ICG) Module) and
Chapter 5 Computer Operating Properly (COP) Module. While configured as oscillator pins, writes
have no effect and reads return undefined values.
RxD — SCI Receive Data Input
The PTE1/RxD pin is the receive data input for the SCI module. When the enable SCI bit, ENSCI, is
clear, the SCI module is disabled, and the PTE1/RxD pin is available for general-purpose I/O. See
TxD — SCI Transmit Data Output
The PTE0/TxD pin is the transmit data output for the SCI module. When the enable SCI bit, ENSCI, is
clear, the SCI module is disabled, and the PTE0/TxD pin is available for general-purpose I/O. See
12.6.2 Data Direction Register E
Data direction register E (DDRE) determines whether each port E pin is an input or an output. Writing a 1
to a DDRE bit enables the output buffer for the corresponding port E pin; a 0 disables the output buffer.
Address:
$0008
Bit 7
65
4321
Bit 0
Read:
0
PTE4
PTE3
PTE2
PTE1
PTE0
Write:
Reset:
Unaffected by reset
Alternative Function:
OSC1
OSC2
RxD
TxD
= Unimplemented
Figure 12-17. Port E Data Register (PTE)
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PDF描述
UTS08E4S CONN RCPT SQ FLANGE 4POS W/SCKT
EGG.1B.304.CLL CONN RCPT 4POS PNL MNT SKT W/NUT
VE-B2K-IY-F4 CONVERTER MOD DC/DC 40V 50W
VE-B2K-IY-F1 CONVERTER MOD DC/DC 40V 50W
VE-B2J-IY-F1 CONVERTER MOD DC/DC 36V 50W
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參數(shù)描述
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MC908GZ16CFA 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:M68HC08 Microcontrollers
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