參數(shù)資料
型號： MC908JL8CDWE
廠商： Freescale Semiconductor
文件頁數(shù)： 67/212頁
文件大?。?/td> 0K
描述： IC MCU 8K FLASH 8MHZ 28-SOIC
標準包裝： 26
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 8MHz
連通性： SCI
外圍設備： LED，LVD，POR，PWM
輸入/輸出數(shù)： 23
程序存儲器容量： 8KB（8K x 8）
程序存儲器類型： 閃存
RAM 容量： 256 x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 13x8b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 28-SOIC（0.295"，7.50mm 寬）
包裝： 管件
產(chǎn)品目錄頁面： 725 (CN2011-ZH PDF)
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Port D
MC68HC908JL8/JK8 MC68HC08JL8/JK8 MC68HC908KL8 Data Sheet, Rev. 3.1
Freescale Semiconductor
159
DDRD[7:0] — Data Direction Register D Bits
These read/write bits control port D data direction. Reset clears DDRD[7:0], configuring all port D pins
as inputs.
1 = Corresponding port D pin configured as output
0 = Corresponding port D pin configured as input
NOTE
Avoid glitches on port D pins by writing to the port D data register before
changing data direction register D bits from 0 to 1. Figure 11-12 shows the
port D I/O logic.
Figure 11-12. Port D I/O Circuit
When DDRDx is a logic 1, reading address $0003 reads the PTDx data latch. When DDRDx is a logic 0,
reading address $0003 reads the voltage level on the pin. The data latch can always be written,
regardless of the state of its data direction bit. Table 11-4 summarizes the operation of the port D pins.
Address:
$0007
Bit 7
6
54
32
1
Bit 0
Read:
DDRD7
DDRD6
DDRD5
DDRD4
DDRD3
DDRD2
DDRD1
DDRD0
Write:
Reset:
000
00
000
Figure 11-11. Data Direction Register D (DDRD)
Table 11-4. Port D Pin Functions
DDRD Bit
PTD Bit
I/O Pin Mode
Accesses to DDRD
Accesses to PTD
Read/Write
Read
Write
0X(1)
1. X = don’t care.
Input, Hi-Z(2)
2. Hi-Z = high impedance.
DDRD[7:0]
Pin
PTD[7:0](3)
3. Writing affects data register, but does not affect the input.
1
X
Output
DDRD[7:0]
PTD[7:0]
READ DDRD ($0007)
WRITE DDRD ($0007)
RESET
WRITE PTD ($0003)
READ PTD ($0003)
PTDx
DDRDx
PTDx
INTERNAL
D
AT
A
B
U
S
To ADC, TIM1, SCI
PTDPU[6:7]
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PDF描述
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參數(shù)描述
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