MC68HC908LJ12 — Rev. 2.1 202 Timer I" />
參數(shù)資料
型號(hào)： MC908LJ12CPBE
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 116/414頁(yè)
文件大?。?/td> 0K
描述： IC MCU 12K FLASH 8MHZ 64-LQFP
標(biāo)準(zhǔn)包裝： 160
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 8MHz
連通性： IRSCI，SPI
外圍設(shè)備： LCD，LVD，POR，PWM
輸入/輸出數(shù)： 32
程序存儲(chǔ)器容量： 12KB（12K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 512 x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 6x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 64-LQFP
包裝： 托盤
產(chǎn)品目錄頁(yè)面： 725 (CN2011-ZH PDF)
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Timer Interface Module (TIM)
Technical Data
MC68HC908LJ12 — Rev. 2.1
202
Timer Interface Module (TIM)
Freescale Semiconductor
11.10.2 TIM Counter Registers
The two read-only TIM counter registers contain the high and low bytes
of the value in the TIM counter. Reading the high byte (TCNTH) latches
the contents of the low byte (TCNTL) into a buffer. Subsequent reads of
TCNTH do not affect the latched TCNTL value until TCNTL is read.
Reset clears the TIM counter registers. Setting the TIM reset bit (TRST)
also clears the TIM counter registers.
NOTE:
If you read TCNTH during a break interrupt, be sure to unlatch TCNTL
by reading TCNTL before exiting the break interrupt. Otherwise, TCNTL
retains the value latched during the break.
Address: T1CNTH, $0021 and T2CNTH, $002C
Bit 7
654321
Bit 0
Read:
Bit 15
14
13
12
11
10
9
Bit 8
Write:
Reset:
00000000
= Unimplemented
Figure 11-5. TIM Counter Registers High (TCNTH)
Address: T1CNTL, $0022 and T2CNTL, $002D
Bit 7
654321
Bit 0
Read:
Bit 7
654321
Bit 0
Write:
Reset:
00000000
= Unimplemented
Figure 11-6. TIM Counter Registers Low (TCNTL)
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PDF描述
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