MC68HC908LJ12 — Rev. 2.1 Technical Data Freescale S" />
參數(shù)資料
型號(hào)： MC908LJ12CPBE
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 15/414頁(yè)
文件大?。?/td> 0K
描述： IC MCU 12K FLASH 8MHZ 64-LQFP
標(biāo)準(zhǔn)包裝： 160
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 8MHz
連通性： IRSCI，SPI
外圍設(shè)備： LCD，LVD，POR，PWM
輸入/輸出數(shù)： 32
程序存儲(chǔ)器容量： 12KB（12K x 8）
程序存儲(chǔ)器類(lèi)型： 閃存
RAM 容量： 512 x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 6x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 64-LQFP
包裝： 托盤(pán)
產(chǎn)品目錄頁(yè)面： 725 (CN2011-ZH PDF)
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Clock Generator Module (CGM)
MC68HC908LJ12 — Rev. 2.1
Technical Data
Freescale Semiconductor
Clock Generator Module (CGM)
111
The relationship between the VCO frequency, fVCLK, and the
reference frequency, fRCLK, is
where N is the integer range multiplier, between 1 and 4095.
In cases where desired bus frequency has some tolerance,
choose fRCLK to a value determined either by other module
requirements (such as modules which are clocked by CGMXCLK),
cost requirements, or ideally, as high as the specified range
reference divider, R = 1.
When the tolerance on the bus frequency is tight, choose fRCLK to
an integer divisor of fBUSDES, and R = 1. If fRCLK cannot meet this
requirement, use the following equation to solve for R with
practical choices of fRCLK, and choose the fRCLK that gives the
lowest R.
4. Calculate N:
5. Calculate and verify the adequacy of the VCO and bus
frequencies fVCLK and fBUS.
f
VCLK
2
P
N
R
----------- f
RCLK
()
=
R
round R
MAX
f
VCLKDES
f
RCLK
--------------------------
integer
f
VCLKDES
f
RCLK
--------------------------
–
×
=
N
round
Rf
VCLKDES
×
f
RCLK
2
P
×
-------------------------------------
=
f
BUS
f
VCLK
2
P
4
×
-----------
=
f
VCLK
2
P
N
R
----------- f
RCLK
()
=
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PDF描述
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