參數(shù)資料
型號: MC9S08AC15MFDE
廠商: FREESCALE SEMICONDUCTOR INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, FLASH, 40 MHz, MICROCONTROLLER, QCC48
封裝: 7 X 7 MM, 1 MM HEIGHT, 0.50 MM PITCH, ROHS COMPLIANT, MO-220VKKD-2, TQFN-48
文件頁數(shù): 156/337頁
文件大?。?/td> 3100K
代理商: MC9S08AC15MFDE
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Inter-Integrated Circuit (S08IICV2)
MC9S08AC16 Series Data Sheet, Rev. 9
Freescale Semiconductor
239
After a repeated start condition (Sr), all other slave devices also compare the first seven bits of the first
byte of the slave address with their own addresses and test the eighth (R/W) bit. However, none of them
are addressed because R/W = 1 (for 10-bit devices) or the 11110XX slave address (for 7-bit devices) does
not match.
After the master-receiver has sent the first byte of the 10-bit address, the slave-transmitter sees an IIC
interrupt. Software must ensure the contents of IICD are ignored and not treated as valid data for this
interrupt.
13.4.3
General Call Address
General calls can be requested in 7-bit address or 10-bit address. If the GCAEN bit is set, the IIC matches
the general call address as well as its own slave address. When the IIC responds to a general call, it acts as
a slave-receiver and the IAAS bit is set after the address cycle. Software must read the IICD register after
the first byte transfer to determine whether the address matches is its own slave address or a general call.
If the value is 00, the match is a general call. If the GCAEN bit is clear, the IIC ignores any data supplied
from a general call address by not issuing an acknowledgement.
13.5
Resets
The IIC is disabled after reset. The IIC cannot cause an MCU reset.
13.6
Interrupts
The IIC generates a single interrupt.
An interrupt from the IIC is generated when any of the events in Table 13-11 occur, provided the IICIE bit
is set. The interrupt is driven by bit IICIF (of the IIC status register) and masked with bit IICIE (of the IIC
control register). The IICIF bit must be cleared by software by writing a 1 to it in the interrupt routine. You
can determine the interrupt type by reading the status register.
13.6.1
Byte Transfer Interrupt
The TCF (transfer complete flag) bit is set at the falling edge of the ninth clock to indicate the completion
of byte transfer.
S
Slave Address
1st 7 bits
R/W
A1
Slave Address
2nd byte
A2
Sr
Slave Address
1st 7 bits
R/W
A3
Data
A
...
Data
A
P
11110 + AD10 + AD9
0
AD[8:1]
11110 + AD10 + AD9
1
Table 13-10. Master-Receiver Addresses a Slave-Transmitter with a 10-bit Address
Table 13-11. Interrupt Summary
Interrupt Source
Status
Flag
Local Enable
Complete 1-byte transfer
TCF
IICIF
IICIE
Match of received calling address
IAAS
IICIF
IICIE
Arbitration Lost
ARBL
IICIF
IICIE
相關PDF資料
PDF描述
MC9S08AC8VFGE 8-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP44
MC9S08DN60VLH 8-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP64
MC9S08DN32CLC 8-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP32
MC9S08DN32MLF 8-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP48
MC9S08DN16MLC 8-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP32
相關代理商/技術(shù)參數(shù)
參數(shù)描述
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MC9S08AC16_09 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:HCS08 Microcontrollers
MC9S08AC16_0911 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:HCS08 Microcontrollers
MC9S08AC16C32E 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:8-Bit HCS08 Central Processor Unit (CPU)