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參數(shù)資料
| 型號： | MC9S08LL36 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 40 MHz, RISC MICROCONTROLLER, PQFP64 |
| 封裝： | 10 X 10 MM, ROHS COMPLIANT, LQFP-64 |
| 文件頁數(shù)： | 175/398頁 |
| 文件大?。?/td> | 4889K |
| 代理商： | MC9S08LL36 |
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Liquid Crystal Display Driver (S08LCDV1)
MC9S08LL64 MCU Series Reference Manual, Rev. 5
256
Freescale Semiconductor
Depending on the HREFSEL bit configuration, VLL3 will be equal to 3*VLCD or 3*(2/3*VLCD) (see
the selected VLL1 and VLL3 values based on the input value of VLCD.
In addition to VLL1 and VLL3, VLL2 is also generated internally when the charge pump is enabled
(CPSEL = 1). For a typical LCD panel, the bias voltages in 1/3 bias mode are:
V3 = VLL3 = VLCDON = 3 × Vref
V2 = VLL2 = 2 × Vref
V1 = VLL1 = Vref
V0 = VSS
NOTE
VLCDON is the LCD panel driving voltage required to turn on an LCD
segment. Since VLL3 and VLCDON are equivalent, VLL3 should be
configured so that it is 3 V or 5 V, depending on the LCD panel
specification.
13.4.4.2.2
LCD External Power Supply, VSUPPLY[1:0] = 11
When VSUPPLY[1:0] = 11, powersw1, powersw2, and powersw3 are deasserted. With powersw3
deasserted, the buffer is disabled ((~BBYPASS & pwersw3) = 0), so VLCD will be configured in a tri-state
condition. VDD is not available to power the LCD module internally, so the LCD module requires an
external power source for VLL1, VLL2, and VLL3 when the charge pump is disabled.
If the charge pump is enabled, external power must be applied to VLL3. With this configuration, the charge
pump will generate the other LCD bias voltages VLL1 and VLL2.
Internal VIREG
If the charge pump is enabled the internal regulated voltage, VIREG, can be used as an input to generate the
LCD bias voltages. In this state external voltage source should not be connected to VLL1. VIREG is
controlled by the LCD regulated voltage control (LCDRVC) register. The figure above, Figure 13-16,
shows that VIREG is connected to VLL1 when the RVEN bit is set.{statement}
VLL1 is connected to the internal charge pump. Using the charge pump, the value of VLL1 is tripled and
output as VLL3. VLL3, an LCD bias voltage, is equal to the voltage required to energize the LCD panel,
Table 13-21. VLL1 Typical Values
VLCD
HREFSEL = 0
Voltage Doubler
HREFSEL = 1
Voltage Tripler
VLL1 = Vref
VLL3 = 3 × Vref
VLL1 = Vref
VLL3 = 3 × Vref
1.4 V
(2/3)
× 1.4 V
2.8 V
1.4 V
4.2 V
1.5 V
(2/3)
× 1.5 V
3.0 V
1.5 V
4.5 V
1.7 V
(2/3)
× 1.7 V
3.4 V
1.7 V
5.1 V
1.8 V
(2/3)
× 1.8 V
3.6 V
1.8 V
5.4 V
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