參數(shù)資料
型號(hào)： MC9S12XEG128VALR
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP112
封裝： LQFP-112
文件頁(yè)數(shù)： 665/1410頁(yè)
文件大?。?/td> 8299K
代理商： MC9S12XEG128VALR
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Chapter 8 S12X Debug (S12XDBGV3) Module
MC9S12XE-Family Reference Manual Rev. 1.13
Freescale Semiconductor
327
8.4.2
Comparator Modes
The S12XDBG contains four comparators, A, B, C, and D. Each comparator can be congured to monitor
CPU12X or XGATE buses. Each comparator compares the selected address bus with the address stored in
DBGXAH, DBGXAM, and DBGXAL. Furthermore, comparators A and C also compare the data buses
to the data stored in DBGXDH, DBGXDL and allow masking of individual data bus bits.
S12X comparator matches are disabled in BDM and during BDM accesses.
The comparator match control logic congures comparators to monitor the buses for an exact address or
an address range, whereby either an access inside or outside the specied range generates a match
condition. The comparator conguration is controlled by the control register contents and the range control
by the DBGC2 contents.
On a match a trigger can initiate a transition to another state sequencer state (see Section 8.4.3”). The
comparator control register also allows the type of access to be included in the comparison through the use
of the RWE, RW, SZE, and SZ bits. The RWE bit controls whether read or write comparison is enabled
for the associated comparator and the RW bit selects either a read or write access for a valid match.
Similarly the SZE and SZ bits allows the size of access (word or byte) to be considered in the compare.
Only comparators B and D feature SZE and SZ.
The TAG bit in each comparator control register is used to determine the triggering condition. By setting
TAG, the comparator will qualify a match with the output of opcode tracking logic and a trigger occurs
before the tagged instruction executes (tagged-type trigger). Whilst tagging, the RW, RWE, SZE, and SZ
bits are ignored and the comparator register must be loaded with the exact opcode address.
If the TAG bit is clear (forced type trigger) a comparator match is generated when the selected address
appears on the system address bus. If the selected address is an opcode address, the match is generated
when the opcode is fetched from the memory. This precedes the instruction execution by an indenite
number of cycles due to instruction pipe lining. For a comparator match of an opcode at an odd address
when TAG = 0, the corresponding even address must be contained in the comparator register. Thus for an
opcode at odd address (n), the comparator register must contain address (n–1).
Once a successful comparator match has occurred, the condition that caused the original match is not
veried again on subsequent matches. Thus if a particular data value is veried at a given address, this
address may not still contain that data value when a subsequent match occurs.
Comparators C and D can also be used to select an address range to trace from. This is determined by the
TRANGE bits in the DBGTCR register. The TRANGE encoding is shown in Table 8-12. If the TRANGE
bits select a range denition using comparator D, then comparator D is congured for trace range
denition and cannot be used for address bus comparisons. Similarly if the TRANGE bits select a range
denition using comparator C, then comparator C is congured for trace range denition and cannot be
used for address bus comparisons.
Match[0, 1, 2, 3] map directly to Comparators[A, B, C, D] respectively, except in range modes (see
Section 8.3.2.4”). Comparator priority rules are described in the trigger priority section (Section 8.4.3.6”).
相關(guān)PDF資料
PDF描述
MC9S12XET256MAAR 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP80
MC9S12XEP768VVLR 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PBGA208
MC9S12XET256VAA 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP80
MC9S12XET256CALR 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP112
MC9S12XEP768MVL 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PBGA208
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MC9S12XEP100CAG 功能描述:16位微控制器 - MCU 1M FLASH S12XEP SAILFI RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線寬度:16 bit 最大時(shí)鐘頻率:24 MHz 程序存儲(chǔ)器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風(fēng)格:SMD/SMT
MC9S12XEP100CAL 功能描述:16位微控制器 - MCU 1M FLASH S12XEP SAILFI RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線寬度:16 bit 最大時(shí)鐘頻率:24 MHz 程序存儲(chǔ)器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風(fēng)格:SMD/SMT
MC9S12XEP100CAL 制造商:Freescale Semiconductor 功能描述:16-BIT MICROCONTROLLER IC HCS12/S12X 5
MC9S12XEP100CVL 功能描述:16位微控制器 - MCU 1M FLASH 64K RAM RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線寬度:16 bit 最大時(shí)鐘頻率:24 MHz 程序存儲(chǔ)器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風(fēng)格:SMD/SMT
MC9S12XEP100J5MAL 5M48H 制造商:Freescale Semiconductor 功能描述:
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