參數(shù)資料
型號(hào)： MCHC908JW32FC
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 99/232頁(yè)
文件大?。?/td> 0K
描述： IC MCU 32K FLASH 8MHZ 48-QFN
標(biāo)準(zhǔn)包裝： 260
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 8MHz
連通性： SPI，USB
外圍設(shè)備： LED，LVD，POR，PWM
輸入/輸出數(shù)： 29
程序存儲(chǔ)器容量： 32KB（32K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 1K x 8
電壓 - 電源 (Vcc/Vdd)： 3.5 V ~ 5.5 V
振蕩器型： 內(nèi)部
工作溫度： 0°C ~ 70°C
封裝/外殼： 48-VFQFN 裸露焊盤
包裝： 托盤
產(chǎn)品目錄頁(yè)面： 726 (CN2011-ZH PDF)
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External Interrupt (IRQ)
MC68HC908JW32 Data Sheet, Rev. 6
188
Freescale Semiconductor
14.5 PTE3/D– Pin
The PTE3 pin is configured as an interrupt input to trigger the IRQ interrupt when the following conditions
are satisfied:
The USB module is disabled
PTE3 pin configured for external interrupt input (PTE3IE = 1)
Setting PTE3IE configures the PTE3 pin to an input pin with an internal pullup device. The PTE3 interrupt
is "ORed" with the IRQ input to trigger the IRQ interrupt Figure 14-1. Therefore, the IRQ status and control
register affects both the IRQ pin and the PTE pin. An interrupt on PTE3 also sets the PTE3 interrupt flag,
PTE3IF, in the IRQ option control register (IOCR).
14.6 IRQ Module During Break Interrupts
The system integration module (SIM) controls whether the IRQ latch can be cleared during the break
state. The BCFE bit in the break flag control register (BFCR) enables software to clear the latches during
To allow software to clear the IRQIRQ latch during a break interrupt, write a logic 1 to the BCFE bit. If a
latch is cleared during the break state, it remains cleared when the MCU exits the break state.
To protect the latches during the break state, write a logic 0 to the BCFE bit. With BCFE at logic 0 (its
default state), writing to the ACK bit in the IRQ status and control register during the break state has no
effect on the IRQ latch.
14.7 IRQ Status and Control Register
The IRQ status and control register (ISCR) controls and monitors operation of the IRQ module. The ISCR
has the following functions:
Shows the state of the IRQ flag
Clears the IRQ latch
Masks IRQ interrupt request
Controls triggering sensitivity of the IRQ pin
IRQF — IRQ Flag
This read-only status bit is high when the IRQ interrupt is pending.
1 = IRQ interrupt pending
0 = IRQ interrupt not pending
Address:
$001E
Bit 7
654321
Bit 0
Read:
0000
IRQF
0
IMASK
MODE
Write:
ACK
Reset:
00000000
= Unimplemented
Figure 14-3. IRQ Status and Control Register (ISCR)
相關(guān)PDF資料
PDF描述
MCHC908MR8MFAE IC MCU 8K FLASH 8MHZ PWM 32-LQFP
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