參數(shù)資料
型號： MCIMX515DJZK8C
廠商： Freescale Semiconductor
文件頁數(shù)： 197/202頁
文件大?。?/td> 0K
描述： IC MPU I.MX51 527MAPBGA
標準包裝： 160
系列： i.MX51
核心處理器： ARM? Cortex?-A8
芯體尺寸： 32-位
速度： 800MHz
連通性： 1 線，EBI/EMI，以太網(wǎng)，I²C，IrDA，MMC，SPI，SSI，UART/USART，USB OTG
外圍設備： DMA，I²S，LCD，POR，PWM，WDT
輸入/輸出數(shù)： 128
程序存儲器類型： ROMless
RAM 容量： 128K x 8
電壓 - 電源 (Vcc/Vdd)： 0.8 V ~ 1.15 V
振蕩器型： 外部
工作溫度： -20°C ~ 85°C
封裝/外殼： 527-TFBGA
包裝： 托盤
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i.MX51 Applications Processors for Consumer and Industrial Products, Rev. 6
94
Freescale Semiconductor
Electrical Characteristics
Table 80 shows timing characteristics of signals presented in Figure 54 and Figure 55.
Table 80. Synchronous Display Interface Timing Characteristics (Pixel Level)
ID
Parameter
Symbol
Value
Description
Unit
IP5
Display interface clock period
Tdicp
(1)
Display interface clock. IPP_DISP_CLK
ns
IP6
Display pixel clock period
Tdpcp
DISP_CLK_PER_PIXEL
× Tdicp
Time of translation of one pixel to display,
DISP_CLK_PER_PIXEL—number of pixel
components in one pixel (1.n). The
DISP_CLK_PER_PIXEL is virtual
parameter to define Display pixel clock
period.
The DISP_CLK_PER_PIXEL is received by
DC/DI one access division to n
components.
ns
IP7
Screen width time
Tsw
(SCREEN_WIDTH)
× Tdicp
SCREEN_WIDTH—screen width in,
interface clocks. horizontal blanking
included.
The SCREEN_WIDTH should be built by
suitable DI’s counter2.
ns
IP8
HSYNC width time
Thsw
(HSYNC_WIDTH)
HSYNC_WIDTH—Hsync width in DI_CLK
with 0.5 DI_CLK resolution. Defined by DI’s
counter.
ns
IP9
Horizontal blank interval 1
Thbi1
BGXP
× Tdicp
BGXP—Width of a horizontal blanking
before a first active data in a line. (in
interface clocks). The BGXP should be built
by suitable DI’s counter.
ns
IP10
Horizontal blank interval 2
Thbi2
(SCREEN_WIDTH -
BGXP - FW)
× Tdicp
Width a horizontal blanking after a last
active data in a line. (in interface clocks)
FW—with of active line in interface clocks.
The FW should be built by suitable DI’s
counter.
ns
IP12
Screen height
Tsh
(SCREEN_HEIGHT)
× Tsw
SCREEN_HEIGHT— screen height in lines
with blanking
The SCREEN_HEIGHT is a distance
between 2 VSYNCs.
The SCREEN_HEIGHT should be built by
suitable DI’s counter.
ns
IP13
VSYNC width
Tvsw
VSYNC_WIDTH
VSYNC_WIDTH—Vsync width in DI_CLK
with 0.5 DI_CLK resolution. Defined by DI’s
counter
ns
IP14
Vertical blank interval 1
Tvbi1
BGYP
× Tsw
BGYP—width of first Vertical
blanking interval in line.The BGYP should
be built by suitable DI’s counter.
ns
IP15
Vertical blank interval 2
Tvbi2
(SCREEN_HEIGHT -
BGYP - FH)
× Tsw
width of second Vertical
blanking interval in line.The FH should be
built by suitable DI’s counter.
ns
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PDF描述
MCIMX537CVV8B MULTIMEDIA PROC 529-TEPBGA
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