參數(shù)資料
型號(hào): MK2049-35SITR
英文描述: 3.3 V Communications Clock PLL
中文描述: 3.3伏通信時(shí)鐘鎖相環(huán)
文件頁(yè)數(shù): 3/11頁(yè)
文件大?。?/td> 135K
代理商: MK2049-35SITR
MK2049-34
3.3 V Communications Clock PLL
MDS 2049-34 C
Integrated Circuit Systems, Inc. 525 Race Street San Jose CA 95126 (408)295-9800tel www.icst.com
3
Revision 121400
Parameter
ABSOLUTE MAXIMUM RATINGS (Note 1)
Supply Voltage, VDD
Inputs and Clock Outputs
Ambient Operating Temperature
Soldering Temperature
Storage Temperature
DC CHARACTERISTICS (VDD = 3.3 V unless noted)
Operating Voltage, VDD
Input High Voltage, VIH
Input Low Voltage, VIL
Output High Voltage, VOH, CMOS level
Output High Voltage, VOH
Output Low Voltage
Operating Supply Current, IDD
Short Circuit Current
Input Capacitance, FS3:0
AC CHARACTERISTICS (VDD = 3.3 V unless noted)
Input Frequency, External Mode
Input Clock Pulse Width
Propagation Delay
Output-Output Skew
Output Clock Rise Time
Output Clock Fall Time
Output Clock Duty Cycle, High Time
Actual mean frequency error versus target
Conditions
Minimum
Typical
Maximum
Units
Referenced to GND
7
V
V
°C
°C
°C
-0.5
-40
VDD+0.5
85
250
150
MK2049-34SI
Max of 10 seconds
-65
3.15
2
3.3
3.45
V
V
V
V
V
V
IOH=-4 mA
IOH=-8 mA
IOL=8 mA
No Load, VDD=3.3 V
Each output
0.8
VDD-0.4
2.4
0.4
7
mA
mA
pF
±50
5
ICLK
8.000
kHz
ns
ns
ps
ns
ns
%
ppm
10
ICLK to CLK
CLK to CLK/2
0.8 to 2.0 V
2.0 to 0.8 V
At VDD/2, except 8K
Any clock selection
0
6
150
2
2
60
0
40
0
Notes:
1. Stresses beyond those listed under Absolute Maximum Ratings could cause permanent damage to the device. Prolonged exposure
to levels above the operating limits but below the Absolute Maximums may affect device reliability.
Electrical Specifications
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