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參數(shù)資料
| 型號： | MK20N512VML100R |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | RISC MICROCONTROLLER, PBGA104 |
| 封裝： | 8 X 8 MM, MAPBGA-104 |
| 文件頁數(shù)： | 14/61頁 |
| 文件大?。?/td> | 888K |
| 代理商： | MK20N512VML100R |
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Table 11. JTAG electricals (continued)
Symbol
Description
Min.
Max.
Unit
J3
TCLK clock pulse width
JTAG and CJTAG
Serial Wire Debug
20
10
—
ns
J4
TCLK rise and fall times
—
3
ns
J5
Boundary scan input data setup time to TCLK rise
20
—
ns
J6
Boundary scan input data hold time after TCLK rise
0
—
ns
J7
TCLK low to boundary scan output data valid
—
30
ns
J8
TCLK low to boundary scan output high-Z
—
30
ns
J9
TMS, TDI input data setup time to TCLK rise
16
—
ns
J10
TMS, TDI input data hold time after TCLK rise
1
—
ns
J11
TCLK low to TDO data valid
—
4
ns
J12
TCLK low to TDO high-Z
—
4
ns
J13
TRST assert time
100
—
ns
J14
TRST setup time (negation) to TCLK high
8
—
ns
J2
J3
J4
TCLK (input)
Figure 5. Test clock input timing
Peripheral operating requirements and behaviors
K20 Sub-Family Data Sheet Data Sheet, Rev. 1, 11/2010.
Freescale Semiconductor, Inc.
Preliminary
21
Preliminary
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MK20X256VLK100R | 32-BIT, FLASH, 100 MHz, RISC MICROCONTROLLER, PQFP80 |
| MK20N512VLK100 | 32-BIT, FLASH, 100 MHz, RISC MICROCONTROLLER, PQFP80 |
| MK20X256VMB100 | 32-BIT, FLASH, 100 MHz, RISC MICROCONTROLLER, PBGA81 |
| MK20N512VMB100R | 32-BIT, FLASH, 100 MHz, RISC MICROCONTROLLER, PBGA81 |
| MK20N512VMB100 | 32-BIT, FLASH, 100 MHz, RISC MICROCONTROLLER, PBGA81 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| MK20X256VLK100 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Up to 100 MHz ARM Cortex-M4 core with DSP instructions delivering 1.25 Dhrystone MIPS per MHz |
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