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參數(shù)資料
| 型號： | MK2304S-1I |
| 元件分類： | 時鐘及定時 |
| 英文描述： | 2304 SERIES, PLL BASED CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO8 |
| 封裝： | 0.150 INCH, SOIC-8 |
| 文件頁數(shù)： | 4/7頁 |
| 文件大?。?/td> | 151K |
| 代理商： | MK2304S-1I |
Zero Delay, Low Skew Buffer
MK2304-1 B
4
Revision 060605
Integrated Circuit Systems, Inc.
● 525 Race Street, San Jose, CA 95126 ● tel (408) 297-1201 ● www.icst.com
MK2304-1
VDD=3.3 V ±10%, Industrial temperature -40 to +85°C
AC Electrical Characteristics
VDD = 3.3 V ±10%, Commercial Temperature 0 to +70° C
Operating Supply Current
100 MHz, CLKIN
IDD
No Load
45
mA
Short Circuit Current
IOS
Each output
TBD
mA
Input Capacitance
CIN
FBIN
7
pF
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Operating Voltage
VDD
3.0
3.6
V
Input High Voltage
VIH
2V
Input Low Voltage
VIL
0.8
V
Output High Voltage
VOH
IOH = -8 mA
2.4
V
Output Low Voltage
VOL
IOL = 8 mA
0.4
V
Operating Supply Current
100 MHz, CLKIN
IDD
No Load
45
mA
Short Circuit Current
IOS
Each output
TBD
mA
Input Capacitance
CIN
FBIN
7
pF
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Output Frequency,
FBIN to CLKA1,
30 pF Load
10
100
MHz
Output Frequency,
FBIN to CLKA1,
15 pf Load
10
133
MHz
Output Rise Time
tOR
0.8 to 2.0 V, CL=30 pF
2.2
ns
Output Rise Time
tOR
0.8 to 2.0 V, CL=15 pF
1.5
ns
Output Fall Time
tOF
0.8 to 2.0 V, CL=30 pF
2.2
ns
Output Fall Time
tOF
0.8 to 2.0 V, CL=15 pF
1.5
ns
Output Clock Duty Cycle
At 1.4 V, CL=30 pf
40
50
60
%
Output Clock Duty Cycle
At 1.4 V, CL=15 pf
45
50
55
%
Device to Device skew, equally
loaded
Rising edges at VDD/2
500
ps
Output to Output skew, equally
loaded, On same bank
Rising edges at VDD/2
200
ps
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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