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參數(shù)資料
| 型號(hào)： | MM912G634CV1AER2 |
| 廠商： | Freescale Semiconductor |
| 文件頁(yè)數(shù)： | 96/349頁(yè) |
| 文件大小： | 0K |
| 描述： | IC 48KS12 LIN2XLS/HS ISENSE |
| 標(biāo)準(zhǔn)包裝： | 2,000 |
| 應(yīng)用： | 自動(dòng) |
| 核心處理器： | HCS12 |
| 程序存儲(chǔ)器類(lèi)型： | 閃存（48 kB） |
| 控制器系列： | HCS12 |
| RAM 容量： | 2K x 8 |
| 接口： | LIN |
| 電源電壓： | 5.5 V ~ 27 V |
| 工作溫度： | -40°C ~ 105°C |
| 安裝類(lèi)型： | 表面貼裝 |
| 封裝/外殼： | 48-LQFP 裸露焊盤(pán) |
| 包裝： | 帶卷 (TR) |
| 供應(yīng)商設(shè)備封裝： | 48-LQFP 裸露焊盤(pán)（7x7） |
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MM912_634 Advance Information, Rev. 10.0
Freescale Semiconductor
185
5.31.3.2.1
BDM Status Register (BDMSTS)
Read: All modes through BDM operation when not secured
Write: All modes through BDM operation when not secured, but subject to the following:
— ENBDM should only be set via a BDM hardware command if the BDM firmware commands are needed. (This does
not apply in special single chip mode).
— BDMACT can only be set by BDM hardware upon entry into BDM. It can only be cleared by the standard BDM
firmware lookup table upon exit from BDM active mode.
— All other bits, while writable via BDM hardware or standard BDM firmware write commands, should only be altered
by the BDM hardware or standard firmware lookup table as part of BDM command execution.
Register Global Address 0x3_FF01
Table 262. BDM Status Register (BDMSTS)
7
65432
10
R
0
0
0
W
Reset
Special Single-Chip Mode
10000
0
All Other Modes
0
00000
00
= Unimplemented, Reserved
= Implemented (do not alter)
0
= Always read zero
Note:
175. ENBDM is read as 1 by a debugging environment in special single chip mode when the device is not secured or secured but fully erased
(Flash). This is because the ENBDM bit is set by the standard BDM firmware before a BDM command can be fully transmitted and
executed.
176. UNSEC is read as 1 by a debugging environment in special single chip mode when the device is secured and fully erased, else it is 0
and can only be read if not secure (see also bit description).
Table 263. BDMSTS Field Descriptions
Field
Description
7
ENBDM
Enable BDM
— This bit controls whether the BDM is enabled or disabled. When enabled, BDM can be made active to allow
firmware commands to be executed. When disabled, BDM cannot be made active but BDM hardware commands are still
allowed.
0
BDM disabled
1
BDM enabled
Note: ENBDM is set out of reset in special single chip mode. In special single chip mode with the device secured, this bit will
not be set until after the Flash erase verify tests are complete.
6
BDMACT
BDM Active Status
— This bit becomes set upon entering BDM. The standard BDM firmware lookup table is then enabled
and put into the memory map. BDMACT is cleared by a carefully timed store instruction in the standard BDM firmware as part
of the exit sequence to return to user code and remove the BDM memory from the map.
0
BDM not active
1
BDM active
4
SDV
Shift Data Valid
— This bit is set and cleared by the BDM hardware. It is set after data has been transmitted as part of a BDM
firmware or hardware read command or after data has been received as part of a BDM firmware or hardware write command.
It is cleared when the next BDM command has been received or BDM is exited. SDV is used by the standard BDM firmware
to control program flow execution.
0
Data phase of command not complete
1
Data phase of command is complete
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