參數資料
型號： MPC5200BV400
廠商： Freescale Semiconductor
文件頁數： 10/72頁
文件大?。?/td> 0K
描述： IC MPU 32BIT 400MHZ 272-PBGA
標準包裝： 40
系列： MPC52xx
核心處理器： 603e G2 LE
芯體尺寸： 32-位
速度： 400MHz
連通性： CAN，EBI/EMI，以太網，I²C，IrDA，J1850，SPI，UART/USART，USB
外圍設備： AC'97，DMA，I²S，POR，PWM，WDT
輸入/輸出數： 56
程序存儲器類型： 外部程序存儲器
RAM 容量： 16K x 8
電壓 - 電源 (Vcc/Vdd)： 1.42 V ~ 1.58 V
振蕩器型： 內部
工作溫度： 0°C ~ 70°C
封裝/外殼： 272-BBGA
包裝： 托盤
MPC5200B Data Sheet, Rev. 4
18
Freescale Semiconductor
Figure 5. Timing Diagram—Standard SDRAM Memory Read Timing
1.3.6.2
Memory Interface Timing-Standard SDRAM Write Command
In Standard SDRAM, all signals are activated on the MEM_CLK from the Memory Controller and captured on the MEM_CLK
clock at the memory device.
Table 19. Standard SDRAM Write Timing
Sym
Description
Min
Max
Units
SpecID
tmem_clk
MEM_CLK period
7.5
—
ns
A5.8
tvalid
Control Signals, Address and MBA Valid
after rising edge of MEM_CLK
—tmem_clk × 0.5 + 0.4
ns
A5.9
thold
Control Signals, Address and MBA Hold after
rising edge of MEM_CLK
tmem_clk × 0.5
—
ns
A5.10
DMvalid
DQM valid after rising edge of MEM_CLK
—
tmem_clk × 0.25 + 0.4
ns
A5.11
DMhold
DQM hold after rising edge of Mem_clk
tmem_clk ×0.25– 0.7
—
ns
A5.12
datavalid
MDQ valid after rising edge of MEM_CLK
—
tmem_clk × 0.75 + 0.4
ns
A5.13
datahold
MDQ hold after rising edge of MEM_CLK
tmem_clk ×0.75– 0.7
—
ns
A5.14
MEM_CLK
Control Signals
MDQ (Data)
MA (Address)
NOTE: Control Signals are composed of RAS, CAS, MEM_WE, MEM_CS, MEM_CS1 and CLK_EN
Active
NOP
READ
NOP
thold
Row
Column
MBA (Bank Selects)
tvalid
thold
tvalid
thold
tvalid
DQM (Data Mask)
DMvalid
DMhold
NOP
datahold
datasetup
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PDF描述
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