參數(shù)資料
型號(hào)： MPC563MVR56R2
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 354/1420頁(yè)
文件大?。?/td> 0K
描述： IC MPU 512K FLASH 56MHZ 388-PBGA
標(biāo)準(zhǔn)包裝： 500
系列： MPC5xx
核心處理器： PowerPC
芯體尺寸： 32-位
速度： 56MHz
連通性： CAN，EBI/EMI，SCI，SPI，UART/USART
外圍設(shè)備： POR，PWM，WDT
輸入/輸出數(shù)： 56
程序存儲(chǔ)器容量： 512KB（512K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 32K x 8
電壓 - 電源 (Vcc/Vdd)： 2.5 V ~ 2.7 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 32x10b
振蕩器型： 外部
工作溫度： -40°C ~ 125°C
封裝/外殼： 388-BBGA
包裝： 帶卷 (TR)
配用： MPC564EVB-ND - KIT EVAL FOR MPC561/562/563/564
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66-MHz Electrical Characteristics
MPC561/MPC563 Reference Manual, Rev. 1.2
G-10
Freescale Semiconductor
G.7
Oscillator and PLL Electrical Characteristics
Note: (VDD = 2.6 V ± 0.1 V, VDDH = 5.0 V ± 0.25 V, TA = TL to TH)
2 This characteristic is for 5-V output and 5-V input pins.
3 0.3V > V
DDA or VDDH, whichever is greater.
4 Within this range, no significant injection will be seen. See QADC64 Disruptive Input Current (I
NA).
5 During reset all 2.6V and 2.6V/5V pads will leak up to 10
A to QVDDL if the pad has a voltage > QVDDL.
6 Maximum leakage occurs at maximum operating temperature. Current decreases by approximately one-half for each
8 to 12 °C, in the ambient temperature range of 50 to 125 °C.
7 All bus pins support two drive strengths capabilities, 25 pF and 50 pF. Current drive is less at the 25-pF
capacitive load. Both modes achieve 66-MHz timing.
8 Only IRQ, TPU, MIOS, GPIO, QADC (when digital inputs) and RESET pins have hysteresis, thus there is no hysteresis
specification on all other pins
9 Transient currents can reach 50mA.
10 KAPWR and IRAMSTBY can be powered-up prior to any other supply or at the same time as the other 2.6 V supplies.
IRAMSTBY must lead or coincide with VDD; however it can lag KAPWR.
11 This parameter is periodically sampled rather than 100% tested
12 Up to 0.5 V during power up/down.
13 To obtain full-range results, V
SSA ≤ VRL ≤ VINDC ≤ VRH ≤ VDDA
14 When using the QADC in legacy mode it is recommended to connect this pin to 2.6V or 3.3V, however it can be
connected to 0V or 5V without damage to the device.
15 A resistor must be placed in series with the IRAMSTBY power supply. Refer to Appendix C, “Clock and Board
16 All injection current is transferred to the V
DDH. An external load is required to dissipate this current to maintain the
power supply within the specified voltage range.
17 Absolute maximum voltage ratings for each pin (see Table G-1) must also be met during this condition.
18 Total injection current for all I/O pins on the chip must not exceed 20 mA (sustained current). Exceeding this limit can
cause disruption of normal operation.
19 Current refers to two QADC64 modules operating simultaneously.
20 Below disruptive current conditions, the channel being stressed has conversion values of 0x3FF for analog inputs
greater than VRH and 0x000 for values less than VRL. This assumes that VRH ≤ VDDA and VRL ≥ VSSA due to the
presence of the sample amplifier. Other channels are not affected by non-disruptive conditions.
Table G-5. Oscillator and PLL
Characteristic
Symbol
Min
Typica
l
Max
Unit
1
Oscillator Startup time (for typical crystal capacitive load)
4-MHz crystal
20-MHz crystal
OSCstart4
OSCstart20
10
ms
2
PLL Lock Time
TLOCK
10001
Input
Clocks
3
PLL Operating Range2
FVCOOUT
30
132
MHz
4
Crystal Operating Range, MODCK=0b010,0b110
MODCK[1:3] = 0b001, 0b011, 0b100, 0b101, 0b111
FCRYSTAL
3
15
5
25
MHz
5
PLL Jitter
PLL Jitter (averaged over 10
s)
FJIT
FJIT10
-1%
-0.3%
+1%
+0.3%
—
6
Limp Mode Clock Out Frequency
—
33
11
173
MHz
7
Oscillator Bias Current (XTAL)
4 MHz
20 MHz
IBIAS
—
| 1.5 |
| 0.8 |
| 4.0 |
mA
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