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參數(shù)資料
| 型號： | MPC603RRX200TC |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 4/31頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MPU 32BIT 200MHZ 255-CBGA |
| 標(biāo)準包裝： | 60 |
| 系列： | MPC6xx |
| 處理器類型： | 32-位 MPC603e PowerPC |
| 速度： | 200MHz |
| 電壓： | 2.5V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 255-BCBGA，F(xiàn)CCBGA |
| 供應(yīng)商設(shè)備封裝： | 255-FCCBGA（21x21） |
| 包裝： | 托盤 |
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PID7t-603e Hardware Specifications, Rev. 5
12
Freescale Semiconductor
Electrical and Thermal Characteristics
This figure provides the JTAG clock input timing diagram.
Figure 5. JTAG Clock Input Timing Diagram
Table 10. JTAG AC Timing Specifications
Vdd = AVdd = 2.5 ± 5% V dc, OVdd = 3.3 ± 5%, GND = 0 V dc, 0 Tj 105° C, CL = 50 pF
Num
Characteristic
Min
Max
Unit
Note
TCK frequency of operation
0
16
MHz
—
1
TCK cycle time
62.5
—
ns
—
2
TCK clock pulse width measured at 1.4 V
25
—
ns
—
3
TCK rise and fall times
0
3
ns
—
4TRST setup time to TCK rising edge
13
—
ns
1
5TRST assert time
40
—
ns
—
6
Boundary scan input data setup time
6
—
ns
2
7
Boundary scan input data hold time
27
—
ns
2
8
TCK to output data valid
4
25
ns
3
9
TCK to output high impedance
3
24
ns
3
10
TMS, TDI data setup time
0
—
ns
—
11
TMS, TDI data hold time
25
—
ns
—
12
TCK to TDO data valid
4
24
ns
—
13
TCK to TDO high impedance
3
15
ns
—
Note:
1. TRST is an asynchronous signal. The setup time is for test purposes only.
2. Non-test signal input timing with respect to TCK.
3. Non-test signal output timing with respect to TCK.
TCK
2
1
VM
3
VM = Midpoint Voltage (1.4 V)
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