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參數(shù)資料
| 型號： | MPC8313CZQAGDA |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 400 MHz, MICROPROCESSOR, PBGA516 |
| 封裝： | 27 X 27 MM, 2.25 MM HEIGHT, 1 MM PITCH, TEPBGAII-516 |
| 文件頁數(shù)： | 28/100頁 |
| 文件大?。?/td> | 1247K |
| 代理商： | MPC8313CZQAGDA |
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MPC8313E PowerQUICC II Pro Processor Hardware Specifications, Rev. 3
Freescale Semiconductor
33
Ethernet: Three-Speed Ethernet, MII Management
8.4
eTSEC IEEE 1588 AC Specifications
Figure 19 provides the data and command output timing diagram.
Figure 19. eTSEC IEEE 1588 Output AC Timing
Figure 20 provides the data and command input timing diagram.
Figure 20. eTSEC IEEE 1588 Input AC Timing
The IEEE 1588 AC timing specifications are in Table 36.
Table 36. eTSEC IEEE 1588 AC Timing Specifications
At recommended operating conditions with L/TVDD of 3.3 V ± 5%.
Parameter/Condition
Symbol
Min
Typ
Max
Unit
Notes
TSEC_1588_CLK clock period
tT1588CLK
3.8
—
TRX_CLK × 9ns
1, 3
TSEC_1588_CLK duty cycle
tT1588CLKH/tT1588CLK
40
50
60
%
TSEC_1588_CLK peak-to-peak
jitter
tT1588CLKINJ
——
250
ps
Rise time eTSEC_1588_CLK
(20%–80%)
tT1588CLKINR
1.0
—
2.0
ns
Fall time eTSEC_1588_CLK
(80%–20%)
tT1588CLKINF
1.0
—
2.0
ns
TSEC_1588_CLK_OUT clock
period
tT1588CLKOUT
2
× tT1588CLK
——
ns
TSEC_1588_CLK_OUT duty cycle
tT1588CLKOTH
/tT1588CLKOUT
30
50
70
%
TSEC_1588_PULSE_OUT
tT1588OV
0.5
—
3.0
ns
TSEC_1588_CLK_OUT
TSEC_1588_PULSE_OUT
TSEC_1588_TRIG_OUT
tT1588OV
tT1588CLKOUT
tT1588CLKOUTH
Note: The output delay is count starting rising edge if tT1588CLKOUT is non-inverting. Otherwise, it is
count starting falling edge.
TSEC_1588_CLK
TSEC_1588_TRIG_IN
tT1588TRIGH
tT1588CLK
tT1588CLKH
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