參數(shù)資料
型號： MPC8313ECVRAFFB
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 333 MHz, MICROPROCESSOR, PBGA516
封裝： 27 X 27 MM, 2.25 MM HEIGHT, 1 MM PITCH, LEAD FREE, TEPBGAII-516
文件頁數(shù)： 10/100頁
文件大?。?/td> 1247K
代理商： MPC8313ECVRAFFB
MPC8313E PowerQUICC II Pro Processor Hardware Specifications, Rev. 3
Freescale Semiconductor
17
DDR and DDR2 SDRAM
Figure 4 illustrates the DDR input timing diagram showing the tDISKEW timing parameter.
Figure 4. DDR Input Timing Diagram
6.2.2
DDR and DDR2 SDRAM Output AC Timing Specifications
Table 20. DDR and DDR2 SDRAM Output AC Timing Specifications for Rev. 1.0 Silicon
Parameter
Symbol 1
Min
Max
Unit
Notes
MCK[
n] cycle time, MCK[n]/MCK[n] crossing
tMCK
610
ns
2
ADDR/CMD output setup with respect to MCK
tDDKHAS
ns
3
333 MHz
2.1
—
266 MHz
2.5
—
ADDR/CMD output hold with respect to MCK
tDDKHAX
ns
3
333 MHz
2.4
—
266 MHz
3.15
—
MCS[
n] output setup with respect to MCK
tDDKHCS
ns
3
333 MHz
2.4
—
266 MHz
3.15
—
MCS[
n] output hold with respect to MCK
tDDKHCX
ns
3
333 MHz
2.4
—
266 MHz
3.15
—
MCK to MDQS Skew
tDDKHMH
–0.6
0.6
ns
4
MDQ//MDM output setup with respect to
MDQS
tDDKHDS,
tDDKLDS
ps
5
333 MHz
800
—
266 MHz
900
—
MDQ//MDM output hold with respect to MDQS
tDDKHDX,
tDDKLDX
ps
5
333 MHz
900
—
266 MHz
1100
—
MDQS preamble start
tDDKHMP
–0.5
× tMCK – 0.6
–0.5
× tMCK + 0.6
ns
6
MCK[
n]
MCK[
n]
tMCK
MDQ[
x]
MDQS[
n]
D1
D0
tDISKEW
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PDF描述
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