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參數(shù)資料
| 型號(hào)： | MPC8544AVTANG |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 45/117頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MPU POWERQUICC III 783-FCBGA |
| 產(chǎn)品培訓(xùn)模塊： | MPC8544E PowerQUICC™ III |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | MPC85xx |
| 處理器類型： | 32-位 MPC85xx PowerQUICC III |
| 速度： | 800MHz |
| 電壓： | 0.95 V ~ 1.05 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 783-BBGA，F(xiàn)CBGA |
| 供應(yīng)商設(shè)備封裝： | 783-FCPBGA（29x29） |
| 包裝： | 托盤 |
| 配用： | MPC8544DS-ND - BOARD DEVELOPMENT SYSTEM 8544 |
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MPC8544E PowerQUICC III Integrated Processor Hardware Specifications, Rev. 6
Freescale Semiconductor
33
Enhanced Three-Speed Ethernet (eTSEC), MII Management
8.5.2.2
GMII Receive AC Timing Specifications
Table 31 provides the GMII receive AC timing specifications.
Figure 14 provides the AC test load for eTSEC.
Figure 14. eTSEC AC Test Load
Figure 15 shows the GMII receive AC timing diagram.
Figure 15. GMII Receive AC Timing Diagram
8.6
MII AC Timing Specifications
This section describes the MII transmit and receive AC timing specifications.
Table 31. GMII Receive AC Timing Specifications
At recommended operating conditions with L/TVDD of 3.3 V ± 5% or 2.5 V ± 5%
Parameter/Condition
Symbol1
Min
Typ
Max
Unit
Notes
RX_CLK clock period
tGRX
—
8.0
—ns—
RX_CLK duty cycle
tGRXH/tGRX
35
—
65
%
—
RXD[7:0], RX_DV, RX_ER setup time to RX_CLK
tGRDVKH
2.0
—
—ns—
RX_CLK to RXD[7:0], RX_DV, RX_ER hold time
tGRDXKH
0.5
—
—ns—
RX_CLK clock rise (20%–80%)
tGRXR
——
1.0
ns
—
RX_CLK clock fall time (80%–20%)
tGRXF
——
1.0
ns
—
Note:
1. The symbols used for timing specifications follow the pattern of t(first two letters of functional block)(signal)(state)(reference)(state) for
inputs and t(first two letters of functional block)(reference)(state)(signal)(state) for outputs. For example, tGRDVKH symbolizes GMII receive
timing (GR) with respect to the time data input signals (D) reaching the valid state (V) relative to the tRX clock reference (K)
going to the high state (H) or setup time. Also, tGRDXKL symbolizes GMII receive timing (GR) with respect to the time data
input signals (D) went invalid (X) relative to the tGRX clock reference (K) going to the low (L) state or hold time. Note that, in
general, the clock reference symbol representation is based on three letters representing the clock of a particular functional.
For example, the subscript of tGRX represents the GMII (G) receive (RX) clock. For rise and fall times, the latter convention
is used with the appropriate letter: R (rise) or F (fall).
Output
Z0 = 50 Ω
LVDD/2
RL = 50 Ω
RX_CLK
RXD[7:0]
tGRDXKH
tGRX
tGRXH
tGRXR
tGRXF
tGRDVKH
RX_DV
RX_ER
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參數(shù)描述 |
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| MPC8544AVTAQGA | 制造商:Freescale Semiconductor 功能描述:PQ38K 8544 - Bulk |
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| MPC8544AVTARJA | 功能描述:數(shù)字信號(hào)處理器和控制器 - DSP, DSC PQ38K 8544 RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT |
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