參數(shù)資料
型號: MPC859
廠商: 飛思卡爾半導體(中國)有限公司
英文描述: Hardware Specifications
中文描述: 硬件規(guī)格
文件頁數(shù): 69/92頁
文件大?。?/td> 1274K
代理商: MPC859
MOTOROLA
MPC866/859 Hardware Specifications
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69
CPM Electrical Characteristics
Table 29 shows the I
2
C (SCL > 100 kHz) timings.
Figure 71 shows the I
2
C bus timing.
Figure 71. I
2
C Bus Timing Diagram
Table 29. I
2
C Timing (SCL > 100 kHz)
Num
Characteristic
Expression
All Frequencies
Unit
Min
Max
200
SCL clock frequency (slave)
fSCL
0
BRGCLK/48
Hz
200
SCL clock frequency (master)
1
1
SCL frequency is given by SCL = BrgClk_frequency / ((BRG register + 3) * pre_scaler * 2).
The ratio SyncClk/(Brg_Clk/pre_scaler) must be greater or equal to 4/1.
fSCL
BRGCLK/16512
BRGCLK/48
Hz
202
Bus free time between transmissions
1/(2.2 * fSCL)
s
203
Low period of SCL
1/(2.2 * fSCL)
s
204
High period of SCL
1/(2.2 * fSCL)
s
205
Start condition setup time
1/(2.2 * fSCL)
s
206
Start condition hold time
1/(2.2 * fSCL)
s
207
Data hold time
0
s
208
Data setup time
1/(40 * fSCL)
s
209
SDL/SCL rise time
1/(10 * fSCL)
s
210
SDL/SCL fall time
1/(33 * fSCL)
s
211
Stop condition setup time
1/2(2.2 * fSCL)
s
SCL
202
205
203
207
204
208
206
209
211
210
SDA
F
Freescale Semiconductor, Inc.
n
.
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PDF描述
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參數(shù)描述
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