參數(shù)資料
型號： MPC859TZP133
廠商： 飛思卡爾半導(dǎo)體(中國)有限公司
英文描述： Hardware Specifications
中文描述： 硬件規(guī)格
文件頁數(shù)： 61/92頁
文件大?。?/td> 1274K
代理商： MPC859TZP133
MOTOROLA
MPC866/859 Hardware Specifications
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61
CPM Electrical Characteristics
Figure 60. HDLC Bus Timing Diagram
12.8
Ethernet Electrical Specifications
Table 24 shows the Ethernet timings as shown in Figure 61 through Figure 65.
Table 24. Ethernet Timing
Num
Characteristic
All Frequencies
Unit
Min
Max
120
CLSN width high
40
—
ns
121
RCLK1 rise/fall time
—
15
ns
122
RCLK1 width low
40
—
ns
123
RCLK1 clock period
1
80
120
ns
124
RXD1 setup time
20
—
ns
125
RXD1 hold time
5
—
ns
126
RENA active delay (from RCLK1 rising edge of the last data bit)
10
—
ns
127
RENA width low
100
—
ns
128
TCLK1 rise/fall time
—
15
ns
129
TCLK1 width low
40
—
ns
130
TCLK1 clock period
1
99
101
ns
131
TXD1 active delay (from TCLK1 rising edge)
—
50
ns
132
TXD1 inactive delay (from TCLK1 rising edge)
6.5
50
ns
133
TENA active delay (from TCLK1 rising edge)
10
50
ns
134
TENA inactive delay (from TCLK1 rising edge)
10
50
ns
TCLK1
CTS1
(Echo Input)
102
100
104
TxD1
(Output)
102
101
RTS1
(Output)
103
104
107
105
F
Freescale Semiconductor, Inc.
n
.
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PDF描述
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