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參數(shù)資料
| 型號(hào)： | MPC885VR66 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類(lèi)： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 66 MHz, RISC PROCESSOR, PBGA357 |
| 封裝： | LEAD FREE, PLASTIC, BGA-357 |
| 文件頁(yè)數(shù)： | 60/87頁(yè) |
| 文件大?。?/td> | 1046K |
| 代理商： | MPC885VR66 |
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MPC885/MPC880 PowerQUICC Hardware Specifications, Rev. 7
Freescale Semiconductor
63
CPM Electrical Characteristics
Figure 64. Ethernet Transmit Timing Diagram
12.9
SMC Transparent AC Electrical Specifications
Table 25 provides the SMC transparent timings as shown in Figure 65.
Table 25. SMC Transparent Timing
Num
Characteristic
All Frequencies
Unit
Min
Max
150
SMCLK clock period1
1
SyncCLK must be at least twice as fast as SMCLK.
100
—
ns
151
SMCLK width low
50
—
ns
151A
SMCLK width high
50
—
ns
152
SMCLK rise/fall time
—
15
ns
153
SMTXD active delay (from SMCLK falling edge)
10
50
ns
154
SMRXD/SMSYNC setup time
20
—
ns
155
RXD1/SMSYNC hold time
5
—
ns
TCLK1
128
TxD1
(Output)
128
TENA(RTS1)
(Input)
Notes:
Transmit clock invert (TCI) bit in GSMR is set.
If RENA is negated before TENA or RENA is not asserted at all during transmit, then the
CSL bit is set in the buffer descriptor at the end of the frame transmission.
1.
2.
RENA(CD1)
(Input)
133
134
132
131
121
129
(Note 2)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MPC885VR80 | 32-BIT, 80 MHz, RISC PROCESSOR, PBGA357 |
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| MPC970FA | 250 MHz, PROC SPECIFIC CLOCK GENERATOR, PQFP52 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| MPC-8890 | 制造商:AAEON 制造商全稱:AAEON 功能描述:Intel Pentium M or Celeron M Processors |
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