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參數(shù)資料
| 型號： | MPC9850VM |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 9/12頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PLL CLOCK GENERATOR 100MAPBGA |
| 標準包裝： | 168 |
| 類型： | 時鐘/頻率發(fā)生器，多路復用器 |
| PLL： | 是 |
| 主要目的： | 聯(lián)網(wǎng)，PowerQUICC III，電信 |
| 輸入： | LVCMOS，LVPECL，晶體 |
| 輸出： | LVCMOS，LVDS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 3:11 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 500MHz |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LBGA |
| 供應商設備封裝： | 100-CABGA（11x11） |
| 包裝： | 托盤 |
| 其它名稱： | 800-2268 MPC9850VM-ND |
MPC9850 Data Sheet
Clock Generator for PowerQUICC III
MPC9850 REVISION 6 FEBRUARY 6, 2013
6
2013 Integrated Device Technology, Inc.
Table 8. LVDS DC Characteristics (TA = –40°C to 85°C)
Symbol
Characteristics
Min
Typ
Max
Unit
Condition
Differential LVDS Clock Outputs (QC0, QC0 and QC1, QC1) for VDD = 3.3 V 5%
VPP
Output Differential Voltage(1) (peak-to-peak)
(LVDS)
1. VPP is the minimum differential input voltage swing required to maintain AC characteristics including tPD and device-to-device skew.
100
400
mV
VOS
Output Offset Voltage
(LVDS)
1050
1600
mV
Table 9. LVPECL DC Characteristics (TA = –40°C to 85°C)(1)
1. AC characteristics are design targets and pending characterization.
Symbol
Characteristics
Min
Typ
Max
Unit
Condition
Differential LVPECL Clock Inputs (CLK1, CLK1) for VDD = 3.3 V 0.5%
VPP
Differential Voltage(2) (peak-to-peak)
(LVPECL)
2. VPP is the minimum differential input voltage swing required to maintain AC characteristics including tPD and device-to-device skew.
250
mV
VCMR
Differential Input Crosspoint Voltage(3)
(LVPECL)
3. VCMR (AC) is the crosspoint of the differential input signal. Normal AC operation is obtained when the crosspoint is within the VCMR (AC)
range and the input swing lies within the VPP (AC) specification. Violation of VCMR (AC) or VPP (AC) impacts the device propagation delay,
device and part-to-part skew.
1.0
VDD – 0.6
V
Table 10. LVCMOS I/O DC Characteristics (TA = –40°C to 85°C)
Symbol
Characteristics
Min
Typ
Max
Unit
Condition
LVCMOS for VDD = 3.3 V 5%
VIH
Input High Voltage
2.0
VDD + 0.3
V
LVCMOS
VIL
Input Low Voltage
0.8
V
LVCMOS
IIN
Input Current(1)
1. Inputs have pull-down resistors affecting the input current.
± 200
AVIN = VDDL or GND
LVCMOS for VDD = 3.3 V5%, VDDOA = 3.3 V 5 and VDDOB = 3.3 V 5%
VOH
Output High Voltage
2.4
V
IOH = –24 mA
VOL
Output Low Voltage
0.5
V
IOL = 24 mA
ZOUT
Output Impedance
14 – 17
LVCMOS for VDD = 3.3 V 5%, VDDOA = 2.5 V 5% and VDDOB= 2.5 V 5%
VOH
Output High Voltage
1.9
V
IOH = –15 mA
VOL
Output Low Voltage
0.4
V
IOL = 15 mA
ZOUT
Output Impedance
18 – 22
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