參數(shù)資料
型號: MR80C52XXX-16P883
廠商: TEMIC SEMICONDUCTORS
元件分類: 微控制器/微處理器
英文描述: 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CQCC44
文件頁數(shù): 192/290頁
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代理商: MR80C52XXX-16P883
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Debug in depth
ARM DDI 0165B
Copyright 2000 ARM Limited. All rights reserved.
C-31
C.10.4
Watchpoint control registers
The format of the control registers depends on how bit 3 is programmed.
If bit 3 of the control register is programmed to a 1, the breakpoint comparators examine
the data address, data, and control signals.
In this case, the format of the control register is as shown in Figure C-8.
Note
You cannot mask bit 8 and bit 3.
Figure C-8 Watchpoint control register for data comparison
Data comparison bit functions are described in Table C-5.
765432
1
0
ENABLE
RANGE
CHAIN
DBGEXT DnTRANS
1
DMAS[1]
DnRW
DMAS[0]
8
Table C-5 Watchpoint control register for data comparison functions
Bit
number
Name
Function
0
DnRW
Compares against the data not read/write signal from the core in
order to detect the direction of the data data bus activity. DnRW
is 0 for a read, and 1 for a write.
2:1
DMAS[1:0]
Compares against the DMAS[1:0] signal from the core in order
to detect the size of the data data bus activity.
4
DnTRANS
Compares against the data not translate signal from the core in
order to determine between a User mode (DnTRANS = 0) data
transfer, and a privileged mode (DnTRANS = 1) transfer.
5
DBGEXT
Is an external input into the EmbeddedICE-RT logic that allows
the watchpoint to be dependent upon some external condition.
The DBGEXT input for watchpoint 0 is labeled DBGEXT[0],
and the DBGEXT input for watchpoint 1 is labeled
DBGEXT[1].
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PDF描述
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