參數(shù)資料
型號： MSC8144TVT1000A
廠商： Freescale Semiconductor
文件頁數(shù)： 32/80頁
文件大?。?/td> 0K
描述： IC DSP QUAD 1GHZ 783FCPBGA
標準包裝： 1
系列： StarCore
類型： SC3400 內(nèi)核
接口： 以太網(wǎng)，I²C，SPI，TDM，UART，UTOPIA
時鐘速率： 1.0GHz
非易失內(nèi)存： 外部
芯片上RAM： 10.5MB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.00V
工作溫度： -40°C ~ 105°C
安裝類型： 表面貼裝
封裝/外殼： 783-BBGA，F(xiàn)CBGA
供應商設備封裝： 783-FCPBGA（29x29）
包裝： 托盤
MSC8144 Quad Core Digital Signal Processor Data Sheet, Rev. 16
Electrical Characteristics
Freescale Semiconductor
38
See also Reset Errata for PLL lock and reset duration.
2
Delay from de-assertion of external PORESET to HRESET deassertion for
external pins and hard coded RCW
33 MHz <= CLKIN < 66 MHz
66 MHz <= CLKIN <= 133 MHz
Delay from de-assertion of external PORESET to HRESET deassertion for
loading RCW the I2C interface
33 MHz <= CLKIN < 44 MHz
44 MHz <= CLKIN < 66 MHz
66 MHz <= CLKIN < 100 MHz
100 MHz <= CLKIN < 133 MHz
15369/CLKIN
34825/CLKIN
92545/CLKIN
107435/CLKIN
124208/CLKIN
157880/CLKIN
615
528
3702
2441
1882
1579
233
262
2103
1627
1242
1187
μs
3
Delay from HRESET deassertion to SRESET deassertion
REFCLK = 33 MHz to 133 MHz
16/CLKIN
640
120
ns
Note:
Timings are not tested, but are guaranteed by design.
Figure 7. Timing for a Reset Configuration Write
Table 19. Timing for a Reset Configuration Write (continued)
No.
Characteristics
Expression
Max
Min
Unit
PORESET
HRESET
Input
Output (I/O)
SRESET
Output (I/O)
RCW_SRC2,RCW_SRC1,RCW_SRC0,STOP_BS and RCFG_CLKIN_RNG
pins must be valid
1
2
3
Reset configuration write
sequence during this
period.
相關(guān)PDF資料
PDF描述
MSC8144SVT800A IC DSP QUAD 800MHZ 783FCBGA
MSC8144SVT1000A IC DSP QUAD 1GHZ 783FCPBGA
KMC8113TVT4800V IC DSP 300/400MHZ 431FCPGA
ECS-H1DY684R CAP TANT 0.68UF 20V 20% 1206
TAJC107M010K CAP TANT 100UF 10V 20% 2312
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參數(shù)描述
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