參數(shù)資料
型號: MSM63188A-XXXGS-BK
廠商: LAPIS SEMICONDUCTOR CO LTD
元件分類: 微控制器/微處理器
英文描述: 4-BIT, MROM, 2 MHz, MICROCONTROLLER, PQFP176
封裝: 24 X 24 MM, 0.50 MM PITCH, PLASTIC, LQFP-176
文件頁數(shù): 224/344頁
文件大小: 1980K
代理商: MSM63188A-XXXGS-BK
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MSM63182A/184A/188A User’s Manual
Chapter 1
Overview
1 – 19
M182A
M184A
M188A
1.5
Pin Descriptions
1.5.1 Descriptions of individual pins
The basic functions of each pin on the MSM63182A, MSM63184A, and MSM63188A are described in Table 1-5,
and the secondary functions in Table 1-6.
Use of a slash (“/”) in a pin name indicates that the pin has a secondary function. See Table 1-6 for the secondary
functions.
In the I/O column, “—” indicates a power supply pin, “I” indicates an input pin, “O” indicates an output pin, and
“I/O” indicates an input/output pin.
Table 1-5(a)
Pin Descriptions (basic functions)
MSM63182A
MSM63184A
MSM63188A
Classifi-
cation
Pin name
Pin
Pad
Pin
Pad
Pin
Pad
l/O
Function
VDD
52
66
52
49
73
112
Positive power supply pin
VSS
41
55
40
38
62
101
Negative power supply pin
VDD1
42
56
41
39
63
102
VDD2
43
57
42
40
64
103
VDD3
44
58
43
41
65
104
VDD4
45
59
44
42
66
105
VDD5
46
60
45
43
67
106
Power supply pins for LCD bias (internally generated):
Connect capacitors (0.1
2F) between these pins and
VSS.
C1
47
61
46
44
68
107
C2
48
62
47
45
69
108
Capacitor connection pins for LCD bias generation:
Connect a capacitor (0.1
2F) between C1 and C2.
VDDI
110
6
110
104
87
123
Positive power supply pin for external interface
(Power supply for input, output, and l/O ports)
VDDL
53
67
53
50
74
113
Positive power supply pin for internal logic (internally
generated):
Connect a capacitor (0.1
2F) between this pin and V
SS.
VDDH
49
63
48
46
70
109
Multiplied power supply pin for power supply backup
(internally generated):
Connect a capacitor (1.0
2F) between this pin and V
SS.
CB1
5064
49
4771
110
Power
Supply
CB2
5165
50
4872
111
Capacitor connection pins for multiplied power supply:
Connect a capacitor (1.0
2F) between CB1 and CB2.
XT0
5872
58
5579
118
I
XT1
5771
57
5478
117
O
Low-speed clock oscillation pins:
Connect a crystal between XT0 and XT1, and connect
capacitor (CG: 5 to 25 pF) between XT0 and VSS.
OSC0
55
69
55
52
76
115
I
Oscillator
OSC1
54
68
54
51
75
114
O
High-speed clock oscillation pins:
Connect a ceramic resonator and capacitors (CL0, CL1)
or external oscillation resistor (ROS) to these pins.
TST1
60
74
60
57
81
120
I
Test
TST2
59
73
59
56
80
119
I
Input pins for testing:
Pull-down resistors are built-in. Not available to the
user.
Reset
RESET
56
70
56
53
77
116
I
Reset input pin:
Setting this pin to a “H” level causes internal circuitry
settings and values to be initialized. Next, if this pin is
set to a “L” level, the execution of instructions will begin
from address 0000H. A pull-down resistor is built-in.
BD
108
4
108
102
O
Buzzer output pin (positive phase)
Buzzer
BDB
109
5
109
103
O
Buzzer output pin (reversed phase)
MD
84
121
O
Melody output pin (positive phase)
Melody
MDB
85
122
O
Melody output pin (reversed phase)
相關(guān)PDF資料
PDF描述
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