參數(shù)資料
型號(hào)： MT9126AS
廠商： Mitel Networks Corporation
英文描述： CMOS Quad ADPCM Transcoder
中文描述： 代碼轉(zhuǎn)換器的CMOS四路差分PcM
文件頁(yè)數(shù)： 9/22頁(yè)
文件大?。?/td> 312K
代理商： MT9126AS
Preliminary Information
MT9126
8-41
Figure 4 - SSI 8-Bit Companded PCM Relative Timing
Figure 5 - SSI 16-Bit Linear PCM Relative Timing
ADPCM i/o
BCLK
ENB1
ENB2/F0od
PCMi/o1
ADPCM i/o
SEL = 0
SEL = 1
32 kb/s
24 kb/s
16 kb/s
SEL for 16 kb/s only
B1
B2
PCMi/o2
1 2 3 4
B1
B2
1 2 3 x
B1
B2
1 2
B3
B4
1 2 1 2
1 2 1 2 1 2 1 2 1 2
7 6 5
3
4
2 1 0
B3
B4
1 2 3 4
1 2 3 x
1 2 3 4
B3
B4
1 2 3 x
1 2 3 4
1 2 3 x
B1
B2
B3
B4
7 6 5
3
4
2 1 0
7 6 5
3
4
2 1 0 7 6 5
3
4
2 1 0
X = undetermined logic level output; don’t care input
Outputs high impedance outside of channel strobe boundaries
Two frame delay from data input to data output
ENB1
ENB2/F0od
EN1
ADPCM i/o
ADPCMi/o
16 kb/s
B
1
1234 1234 1234 1234
123x 123x 123x 123x
12
SEL = 1
SEL = 1
SEL = 0
AA
AA
AA
AA
AA
BCLK
...
SEL for 16 kb/s only
(2.048 MHz only)
PCMi/o1
PCMi/o2
SSS 12 11 10 9 8 7 6 5 4 3 2 1 0
SSS 12 11 10 9 8 7 6 5 4 3 2 1 0
SSS 12 11 10 9 8 7 6 5 4 3 2 1 0
B1
B2
S = 3 bits sign extension
μ
Law is 13 bit 2’s complement data (bits 0 -12)
A-Law is 12 bit 2’s complement data (shifted left once and utilizing
bits 1 - 12, bit 0 not defined)
32 kb/s
24 kb/s
B3
B4
SSS 12 11 10 9 8 7 6 5 4 3 2 1 0
Notes:
B
2
B
3
B
4
12 12 12
B
1
12
B
2
B
3
B
4
12 12 12
B1
B2
B3
B4
1234 1234
123x 123x
B3
B4
B
1
12
B
2
B
3
B
4
12 12 12
X = undetermined logic level output; don’t care input
Outputs high impedance outside of channel strobe boundaries
Two frame delay from data input to data output
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PDF描述
MT9126 Quad ADPCM Transcoder(四ADPCM編解碼器)
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參數(shù)描述
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