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參數(shù)資料
| 型號： | NB3N3020DTG |
| 廠商： | ON Semiconductor |
| 文件頁數(shù)： | 2/9頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK MULTIPLIER 3.3V 16-TSSOP |
| 標(biāo)準(zhǔn)包裝： | 96 |
| 類型： | 時鐘乘法器 |
| PLL： | 是 |
| 輸入： | LVCMOS，LVTTL，晶體 |
| 輸出： | LVCMOS，LVPECL，LVTTL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:2 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 210MHz |
| 除法器/乘法器： | 是/是 |
| 電源電壓： | 2.97 V ~ 3.63 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 16-TSSOP（0.173"，4.40mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 16-TSSOP |
| 包裝： | 管件 |
| 其它名稱： | NB3N3020DTG-ND NB3N3020DTGOS |
NB3N3020
http://onsemi.com
2
Phase
Detector
Loop Filter
VCO
Clock
Buffer/
Crystal
Oscillator
%N
Select Control Block
Pre
Sca
ler
LVCMOS/
LVPECL
Output
VDD
GND
OE2
OE1
CLK1
CLK2
Sel0 Sel1 Sel2
X2
X1 /CLK
527 MHz Crystal
or
2 – 210 MHz Clock
Figure 1. NB3N3020 Simplified Logic Diagram
LVTTL
Output
CLK2
Table 1. PIN DESCRIPTION
Pin
Name
I/O
Description
6
Sel0
TriLevel Input
Frequency select input 0. When left open, defaults to VDD/ 2. See output select Table 2
for details.
5
Sel1
TriLevel Input
Frequency select input 1. When left open, defaults to VDD/ 2. See output select Table 2
for details.
4
Sel2
TriLevel Input
Frequency select input 2. When left open, defaults to VDD/ 2. See output select Table 2
for details.
1, 11, 15
VDD
Power Supply
Positive supply voltage pins are connected to +3.3 V supply voltage.
2
X1/CLK
Input
Crystal or Clock input. Connect to 5 27 MHz crystal source or 2 – 210 MHz single
ended clock. See Table 2.
3
X2
Input
Crystal input. Connect to a 5 – 27 MHz crystal or leave unconnected for clock input. See
Table 2.
7
OE1
LVTTL/LVCMOS
Input
Output enable input that synchronously tristates CLK1 output when low. Internal pullup
resistor to VDD.
16
OE2
LVTTL/LVCMOS
Input
Output enable input that when LOW synchronously controls LVPECL outputs by forcing
CLK2 LOW and CLK2 HIGH. Internal pullup resistor to VDD.
8, 9, 12
GND
Power Supply
Ground 0 V. These pins provide GND return path for the devices.
13
CLK2
LVPECL Output
Inverted clock output. Clock frequency equals input frequency times multiplier.
14
CLK2
LVPECL Output
Noninverted clock output. Clock frequency equals input frequency times multiplier.
10
CLK1
LVTTL/ LVCMOS
Output
Clock Output. Clock frequency equals input frequency times multiplier.
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