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參數資料
| 型號： | OR2C06A-3S144I |
| 廠商： | Electronic Theatre Controls, Inc. |
| 元件分類： | FPGA |
| 英文描述： | Field-Programmable Gate Arrays |
| 中文描述： | 現場可編程門陣列 |
| 文件頁數： | 185/192頁 |
| 文件大?。?/td> | 3148K |
| 代理商： | OR2C06A-3S144I |
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Data Sheet
ORCA Series 2 FPGAs
June 1999
92
Lucent Technologies Inc.
Pin Information (continued)
Table 25. OR2C/2T06A, OR2C/2T08A, OR2C/2T10A, OR2C/2T12A, and OR2C/2T15A/B
256-Pin PBGA Pinout
Pin
2C/2T06A Pad
2C/2T08A Pad
2C/2T10A Pad
2C/2T12A Pad
2C/2T15A/B Pad
Function
C2
PL1D
I/O
D2
PL1C
PL1B
PL1C
I/O
D3
PL1B
PL1A
PL1B
I/O
E4
PL1A
PL2D
I/O-A0
C1
—
PL2C
PL2A
I/O
D1
—
PL2B
PL3D
I/O
E3
—
PL2A
PL3A
I/O
E2
PL2D
PL3D
PL4D
I/O-VDD5
E1
PL2C
PL3C
PL3A
PL4A
I/O
F3
PL2B
PL3B
PL4D
PL5D
I/O
G4
PL2A
PL3A
PL4A
PL5A
I/O-A1
F2
—
PL4D
PL5D
PL6D
I/O
F1
PL3D
PL4D
PL4A
PL5A
PL6A
I/O-A2
G3
PL3C
PL4C
PL5C
PL6D
PL7D
I/O
G2
PL3B
PL4B
PL5B
PL6B
PL7B
I/O
G1
PL3A
PL4A
PL5A
PL6A
PL7A
I/O-A3
H3
PL4D
PL5D
PL6D
PL7D
PL8D
I/O
H2
PL4C
PL5C
PL6C
PL7C
PL8C
I/O
H1
PL4B
PL5B
PL6B
PL7B
PL8B
I/O
J4
PL4A
PL5A
PL6A
PL7A
PL8A
I/O-A4
J3
PL5D
PL6D
PL7D
PL8D
PL9D
I/O-A5
J2
PL5C
PL6C
PL7C
PL8C
PL9C
I/O
J1
PL5B
PL6B
PL7B
PL8B
PL9B
I/O
K2
PL5A
PL6A
PL7A
PL8A
PL9A
I/O-A6
K3
PL6D
PL7D
PL8D
PL9D
PL10D
I/O
K1
PL6C
PL7C
PL8C
PL9C
PL10C
I/O
L1
PL6B
PL7B
PL8B
PL9B
PL10B
I/O
L2
PL6A
PL7A
PL8A
PL9A
PL10A
I/O-A7
L3
PL7D
PL8D
PL9D
PL10D
PL11D
I/O
L4
PL7C
PL8C
PL9C
PL10C
PL11C
I/O-VDD5
M1
PL7B
PL8B
PL9B
PL10B
PL11B
I/O
M2
PL7A
PL8A
PL9A
PL10A
PL11A
I/O-A8
M3
PL8D
PL9D
PL10D
PL11D
PL12D
I/O-A9
M4
PL8C
PL9C
PL10C
PL11C
PL12C
I/O
N1
PL8B
PL9B
PL10B
PL11B
PL12B
I/O
N2
PL8A
PL9A
PL10A
PL11A
PL12A
I/O-A10
N3
PL9D
PL10D
PL11D
PL12D
PL13D
I/O
P1
PL9C
PL10C
PL11C
PL12C
PL13C
I/O
P2
PL9B
PL10B
PL11B
PL12B
PL13B
I/O
R1
PL9A
PL10A
PL11A
PL12A
PL13A
I/O-A11
Notes:
The W3 pin on the 256-pin PBGA package is unconnected for all devices listed in this table.
The OR2C/2T08A do not have bond pads connected to the 256-pin PBGA package pins F2 and Y17.
The pins labeled I/O-VDD5 are user I/Os for the OR2CxxA and OR2TxxB series, but they are connected to VDD5 for the OR2TxxA series.
The pins labeled VSS-ETC are the 4 x 4 array of thermal balls located at the center of the package. The balls can be attached to the ground
plane of the board for enhanced thermal capability (see Table 29), or they can be left unconnected.
相關PDF資料 |
PDF描述 |
|---|---|
| OR2C06A-3S160 | Field-Programmable Gate Arrays |
| OR2C06A-3S160I | Field-Programmable Gate Arrays |
| OR2C06A-3S208 | Field-Programmable Gate Arrays |
| OR2C06A-3S208I | Field-Programmable Gate Arrays |
| OR2C06A-3S240 | Field-Programmable Gate Arrays |
相關代理商/技術參數 |
參數描述 |
|---|---|
| OR2C06A-3S160 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
| OR2C06A-3S160I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
| OR2C06A-3S208 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
| OR2C06A-3S208I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
| OR2C06A3S208I-DB | 功能描述:FPGA - 現場可編程門陣列 Use ECP/EC or XP RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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