參數(shù)資料
型號(hào)： P89LPC9151FDH,129
廠商： NXP Semiconductors
文件頁(yè)數(shù)： 18/27頁(yè)
文件大小： 0K
描述： IC 80C51 MCU FLASH 2KB 14TSSOP
標(biāo)準(zhǔn)包裝： 96
系列： LPC900
核心處理器： 8051
芯體尺寸： 8-位
速度： 18MHz
連通性： I²C，UART/USART
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 12
程序存儲(chǔ)器容量： 2KB（2K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 256 x 8
電壓 - 電源 (Vcc/Vdd)： 2.4 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 4x8b; D/A 1x8b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 14-TSSOP（0.173"，4.40mm 寬）
包裝： 管件
其它名稱： 568-8738-5
935290259129
P89LPC9151FDH,129-ND
PIC18F87J72 FAMILY
DS39979A-page 82
Preliminary
2010 Microchip Technology Inc.
7.4
Erasing Flash Program Memory
The minimum erase block is 512 words or 1,024 bytes.
Only through the use of an external programmer, or
through ICSP control, can larger blocks of program
memory be bulk erased. Word erase in the Flash array
is not supported.
When initiating an erase sequence from the micro-
controller itself, a block of 1,024 bytes of program
memory is erased. The Most Significant 12 bits of the
TBLPTR<21:10> point to the block being erased.
TBLPTR<9:0> are ignored.
The EECON1 register commands the erase operation.
The WREN bit must be set to enable write operations.
The FREE bit is set to select an erase operation. For
protection, the write initiate sequence for EECON2
must be used.
A long write is necessary for erasing the internal Flash.
Instruction execution is halted while in a long write
cycle. The long write will be terminated by the internal
programming timer.
7.4.1
FLASH PROGRAM MEMORY
ERASE SEQUENCE
The sequence of events for erasing a block of internal
program memory location is:
1.
Load Table Pointer register with the address
being erased.
2.
Set the WREN and FREE bits (EECON1<2,4>)
to enable the erase operation.
3.
Disable interrupts.
4.
Write 55h to EECON2.
5.
Write 0AAh to EECON2.
6.
Set the WR bit. This will begin the erase cycle.
7.
The CPU will stall for duration of the erase for
TIE (see parameter D133B).
8.
Re-enable interrupts.
EXAMPLE 7-2:
ERASING FLASH PROGRAM MEMORY
MOVLW
CODE_ADDR_UPPER
; load TBLPTR with the base
MOVWF
TBLPTRU
; address of the memory block
MOVLW
CODE_ADDR_HIGH
MOVWF
TBLPTRH
MOVLW
CODE_ADDR_LOW
MOVWF
TBLPTRL
ERASE
BSF
EECON1, WREN
BSF
EECON1, FREE
; enable Erase operation
BCF
INTCON, GIE
; disable interrupts
Required
MOVLW
55h
Sequence
MOVWF
EECON2
; write 55h
MOVLW
0AAh
MOVWF
EECON2
; write 0AAh
BSF
EECON1, WR
; start erase (CPU stall)
BSF
INTCON, GIE
; re-enable interrupts
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PDF描述
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