參數(shù)資料
型號(hào)： PEF24622
英文描述： ?SOCRATES-4?
中文描述： ？蘇格拉底- 4？
文件頁(yè)數(shù)： 24/73頁(yè)
文件大?。?/td> 1618K
代理商： PEF24622
PEB 2466
PEF 2466
Operational Description
Hardware Reference Manual
15
2001-02-20
4.2.3
The
μ-Law
compressor unit of the SICOFI
4-μC automatically adds 1.94 dB gain, which
has to be considered for the total gain calculation. The accumulated gain of all
programmable transmit filters (AX1+AX2+FRX) must not exceed 7 dB if the device is set
to μ-Law operation. If the device is set to A-Law operation, then the accumulated gain
must not exceed 9 dB.
Compressor Gain Relative to Coding Law
Figure 6
Analog and PCM Signal Levels in A-Law Mode
Figure 7
Analog and PCM Signal Levels in μ-Law Mode
A-Law
Compressor
Transmit
A-Law
Expander
Receive
0 dBm0
1014 Hz
0 dBm0
DXA/B
DXA/B
A/D
0 dB
Gain
D/A
0 dB
Gain
V
OUT
V
IN
1014 Hz
1.095 V
rms
1.095 V
rms
2466_207
A/D
μ
-Law
Compressor
[+1.94 dB]
Transmit
D/A
μ
-Law
Expander
Receive
V
OUT
V
IN
1014 Hz
1.091 V
rms
1.091 V
rms
1.94 dBm0
1014 Hz
0 dBm0
DXA/B
DXA/B
0 dB
Gain
0 dB
Gain
2466_208
相關(guān)PDF資料
PDF描述
PEF2466-H A-Law/u-Law CODEC
PEF24901 ISDN LINE INTERFACE|BASIC|CMOS|QFP|64PIN|PLASTIC
PEF24901H ?Quad ISDN Echocancellation Circuit Digital Front-End for 4B3T Line Code?
PEF24902 ISDN Line Interface
PEF24902H ?Quad ISDN Echocancellation Circuit Analog Front End - 2B1Q/4B3T Code?
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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PEF24624EV1.2-G 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad ISDN Hi V Power Controller RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
PEF24624EV1.2PB 制造商:Infineon Technologies AG 功能描述:SP000007812_SHDSL_TRAYS_PB
PEF24624EV12-G 制造商:Rochester Electronics LLC 功能描述:
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