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參數(shù)資料
| 型號： | PIC14000-04/SO |
| 廠商： | Microchip Technology |
| 文件頁數(shù)： | 108/153頁 |
| 文件大小： | 0K |
| 描述： | IC MCU OTP 4KX14 A/D 28SOIC |
| 產(chǎn)品培訓(xùn)模塊： | Asynchronous Stimulus 8-bit PIC® Microcontroller Portfolio |
| 標(biāo)準(zhǔn)包裝： | 27 |
| 系列： | PIC® 14 |
| 核心處理器： | PIC |
| 芯體尺寸： | 8-位 |
| 速度： | 4MHz |
| 連通性： | I²C |
| 外圍設(shè)備： | POR，溫度傳感器，WDT |
| 輸入/輸出數(shù)： | 20 |
| 程序存儲器容量： | 7KB（4K x 14） |
| 程序存儲器類型： | OTP |
| RAM 容量： | 192 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | 斜率 A/D |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 28-SOIC（0.295"，7.50mm 寬） |
| 包裝： | 管件 |
| 配用： | ISPICR1-ND - ADAPTER IN-CIRCUIT PROGRAMMING 309-1073-ND - ADAPTER 28-SOIC TO 28-SOIC 309-1024-ND - ADAPTER 28-SOIC TO 28-DIP 309-1023-ND - ADAPTER 28-SOIC TO 28-DIP |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁當(dāng)前第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁
PIC14000
DS40122B-page 58
Preliminary
1996 Microchip Technology Inc.
Caution:
Reading or writing the ADTMR register
during an A/D conversion cycle can pro-
duce unpredictable results and is not
recommended.
During conversion one or both of the following events
will occur:
1.
capture event
2.
timer overow
In a capture event, the comparator trips when the slope
voltage on the CDAC output exceeds the input voltage,
causing the comparator output to transition from high to
low. This causes a transfer of the current timer count to
the
capture
register
and
sets
the ADCIF
ag
(PIR1<1>).
Note:
The correct sequence for writing the
ADTMR register is HI byte followed by LO
byte. Reversing this order will prevent the
A/D timer from running.
A CPU interrupt will be generated if bit ADCIE
(PIE1<1>) is set to ‘1’ (interrupt enabled). In addition,
the Global Interrupt Enable and Peripheral Interrupt
Enables (INTCON<7,6>) must also be set. Software is
responsible for clearing the ADCIF ag prior to the next
conversion cycle. Note that this interrupt can only occur
once per conversion cycle.
In a timer overow condition, the timer rolls over from
FFFFh to 0000h, and a capture overow ag (OVFIF)
is asserted (PIR1<0>). The timer continues to incre-
ment following a timer overow. A CPU interrupt can be
generated if bit OVFIE (PIE1<0>) is set (interrupt
enabled). In addition, the Global Interrupt Enable and
Peripheral Interrupt Enables (INTCON<7,6>) must also
be set. Software is responsible for clearing the OVFIF
ag prior to the next conversion cycle.
FIGURE 8-1:
A/D BLOCK DIAGRAM
(nominal)
ADOFF
WRITE_TMR
OSC1
1
0
FOSC
(Conguration Bit)
Internal
ADTMRH
ADTMRL
Clock
Stop
Logic
Timer
(OVFIF, PIR1<0>)
ADCAPH
ADCAPL
Oscillator
Analog
Mux
Prog. Ref. A
7
6
5
4
3
2
1
0
Temp sensor
SREFLO
SREFHI
RA2/AN2
RA1/AN1
RA0/AN0
A/D Capture
A/D
Capture Interrupt
ADOFF
CDAC
~2.5uA~5uA~10uA~20uA
ADCON1<7:4>
0.1
F
ADRST (ADCON0<1>)
RA3/AN3
8
~100
ADOFF
Bandgap Ref.
Prog. Ref. B
9
~ 1 kohm
RD4/AN4
RD5/AN5
RD6/AN6
RD7/AN7
10
11
12
13
RESERVED
14
15
AMUXOE
(ADCIF, PIR1<1>)
Overow
Internal
Data
Bus
ADRST
4
Note 2
Note 1:
All current sources are disabled if ADRST = ‘1’
Note 2:
Approximately 3.5 microsecond time constant
Note 1
4-Bit Current DAC
ADCON0<7:4>
(SLPCON<0>)
(ADCON0<2>)
RA0/AN0
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