參數(shù)資料
型號： PIC16F785-I/SS
廠商： Microchip Technology
文件頁數(shù)： 143/206頁
文件大?。?/td> 0K
描述： IC PIC MCU FLASH 2KX14 20SSOP
產(chǎn)品培訓模塊： Asynchronous Stimulus
8-bit PIC® Microcontroller Portfolio
標準包裝： 67
系列： PIC® 16F
核心處理器： PIC
芯體尺寸： 8-位
速度： 20MHz
外圍設備： 欠壓檢測/復位，POR，PWM，WDT
輸入/輸出數(shù)： 17
程序存儲器容量： 3.5KB（2K x 14）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 256 x 8
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5.5 V
數(shù)據(jù)轉換器： A/D 14x10b
振蕩器型： 內部
工作溫度： -40°C ~ 85°C
封裝/外殼： 20-SSOP（0.209"，5.30mm 寬）
包裝： 管件
產(chǎn)品目錄頁面： 639 (CN2011-ZH PDF)
配用： XLT20SS1-1-ND - SOCKET TRANSITION 20DIP 20SSOP
XLT20SS-1-ND - SOCKET TRANSITION 18DIP 20SSOP
AC162060-ND - HEADER INTRFC MPLAB ICD2 20PIN
AC164307-ND - MODULE SKT FOR PM3 28SSOP
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁當前第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁
2008 Microchip Technology Inc.
DS41249E-page 39
PIC16F785/HV785
4.2.3.3
RA2/AN2/T0CKI/INT/C1OUT
Figure 4-3 shows the diagram for this pin. The RA2 pin
is configurable to function as one of the following:
General purpose I/O
Analog input for the A/D
Clock input for TMR0
External edge triggered interrupt
Digital output from Comparator 1
FIGURE 4-3:
BLOCK DIAGRAM OF RA2
4.2.3.4
RA3/MCLR/VPP
Figure 4-4 shows the diagram for this pin. The RA3 pin
is configurable to function as one of the following:
General purpose input
Master Clear Reset with weak pull-up
FIGURE 4-4:
BLOCK DIAGRAM OF RA3
I/O pin
VDD
VSS
D
Q
CK
Q
D
Q
CK
Q
D
Q
CK
Q
D
Q
CK
Q
VDD
Weak
ANS2
Data Bus
WR
WPUA
RD
WPUA
RD
PORTA
WR
PORTA
WR
TRISA
RD
TRISA
WR
IOCA
RD
IOCA
To A/D Converter
0
1
To INT
To TMR0
ANS2
RAPU
Interrupt-on-
Change
C1OUT
C1OE
D
EN
Q
D
EN
Q
D
EN
Q
Q1
Q3
RD PORTA
Input
VSS
D
Q
CK
Q
RD
PORTA
WR
IOCA
RD
IOCA
Reset
MCLRE
RD
TRISA
VSS
MCLRE
VDD
Weak
MCLRE
Interrupt-on-
Change
pin
D
EN
Q
D
EN
Q
D
EN
Q
Q1
Q3
RD PORTA
D
Q
CK
Q
Data Bus
WR
WPUA
RD
WPUA
RAPU
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