THLD
參數(shù)資料
型號(hào)： PIC18F25K20-I/ML
廠商： Microchip Technology
文件頁(yè)數(shù)： 33/42頁(yè)
文件大小： 0K
描述： IC PIC MCU FLASH 16KX16 28QFN
產(chǎn)品培訓(xùn)模塊： PIC18 K-Series
XLP Deep Sleep Mode
8-bit PIC® Microcontroller Portfolio
標(biāo)準(zhǔn)包裝： 61
系列： PIC® XLP™ 18F
核心處理器： PIC
芯體尺寸： 8-位
速度： 64MHz
連通性： I²C，SPI，UART/USART
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，HLVD，POR，PWM，WDT
輸入/輸出數(shù)： 24
程序存儲(chǔ)器容量： 32KB（16K x 16）
程序存儲(chǔ)器類型： 閃存
EEPROM 大?。?/td> 256 x 8
RAM 容量： 1.5K x 8
電壓 - 電源 (Vcc/Vdd)： 1.8 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 11x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 28-VQFN 裸露焊盤(pán)
包裝： 管件
產(chǎn)品目錄頁(yè)面： 656 (CN2011-ZH PDF)
配用： AC164112-ND - VOLTAGE LIMITER MPLAB ICD2 VPP
AC164322-ND - MODULE SOCKET MPLAB PM3 28/44QFN
2009 Microchip Technology Inc.
Advance Information
DS41297F-page 39
PIC18F2XK20/4XK20
P12
THLD2
Input Data Hold Time from MCLR/VPP/RE3
↑
2—
μs
P13
TSET2VDD
↑ Setup Time to MCLR/VPP/RE3 ↑
100
—
ns
P14
TVALID
Data Out Valid from PGC
↑
10
—
ns
P15
TSET3PGM
↑ Setup Time to MCLR/VPP/RE3 ↑
2—
μs
P16
TDLY8
Delay between Last PGC
↓ and MCLR/VPP/RE3 ↓
0—
s
P17
THLD3MCLR/VPP/RE3
↓ to VDD ↓
—
100
ns
P18
THLD4MCLR/VPP/RE3
↓ to PGM ↓
0—
s
P19
THIZ
Delay from PGC
↑ to PGD High-Z
3
10
nS
P20
TPPDP
Hold time after VPP changes
5
—
μs
6.0
AC/DC CHARACTERISTICS TIMING REQUIREMENTS FOR PROGRAM/
VERIFY TEST MODE (CONTINUED)
Standard Operating Conditions
Operating Temperature: 25
°C is recommended
Param
No.
Sym.
Characteristic
Min.
Max.
Units
Conditions
Note 1:
Do not allow excess time when transitioning MCLR between VIL and VIHH; this can cause spurious program
executions to occur. The maximum transition time is:
1 TCY + TPWRT (if enabled) + 1024 TOSC (for LP, HS, HS/PLL and XT modes only) + 2 ms (for HS/PLL mode only)
+ 1.5
μs (for EC mode only) where TCY is the instruction cycle time, TPWRT is the Power-up Timer period and
TOSC is the oscillator period. For specific values, refer to the Electrical Characteristics section of the device data
sheet for the particular device.
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PDF描述
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